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如何实现一种基于FPGA的横向FIR滤波器设计？ 横向FIR滤波器的设计 设经过AD采集得到的输入序列为x(n)，其通过单位冲激响应为h(n)的因果FIR滤波器后，输出y(n)在时域可表示为线性卷积和的形式： 其中N-1为FIR滤波器阶数（也称抽头数），可以明显的看出h(n)是长度为抽头数加一的有限长序列，不失一般性的设抽头数为3的FIR单位冲激响应h(n)为， 依卷积和画出信号流程图如下， 我们必须明确这里的自变量n表示的并非是连续时间，而是第N次AD采样。 首先根据流程图所示，我们需要设计一个关于x(n)的移位电路，其RTL视图如下， 如图所示的x(n)的移位功能在Verilog中可以通过如下代码实现，注意clk是与数据同步的AD的采样率时钟（AD当前数据建立后，采用一个脉冲标志可实现）。 input clk; input signed[8:0] x_in; output reg signed [8:0] xn; output reg signed [8:0] xn_1; output reg signed [8:0] xn_2; output reg signed [8:0] xn_3; always@(posedge clk) begin xn = x_in;//x(n) xn_1 = xn;//x(n-1) xn_2 = xn_1;//x(n-2) xn_3