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实验二3—8译码器设计
实验目的
.掌握3-8译码器的设计方法；
.掌握ifelse语句和case语句的使用方法；
.掌握VHDL电路的设计、仿真和硬件测试方法
设计描述及方法
.设计电路的接口描述
输入变量为三个A,B,C,输出变量有8个，即Y0?Y7。
G1,G2A,G2B为选通输入，仅当Gl=l,G2A=0,G2B=0时，译码器能够正确输出，否则,译码器输出无效，Y0?Y7均为高电平。
.电路设计基本方法
译码器输出连接8个二极管，低电平显示输出端有效。
设计步骤
完成3—8译码器的VHDL描述，并对其进行波形仿真，确定结果正确。
四、实验思考题
.对于以上译码器，考虑用函数conv_integer（在程序包std」ogic_unsigned中定义）,该如何实现？
.要实现带使能端的BCD-7段译码器，该如何实现？
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