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《计算机组成原理与系统结构》实验指导书

实验1运算器组成实验

实验序号：1实验名称：运算器组成实验

适用专业：计算机科学与技术学时数：4学时

一、实验目的

1、掌握简单运算器的数据传送通路。

2、验证运算功能发生器（74LS181）的组合功能。

二、实验原理

实验中所用的运算器数据通路如图1-1所示。其中运算器由两片74LS181

以并/串形式构成8位字长的ALU。运算器经过一个三态门（74LS245）和数据总

线相连，运算器的两个数据输入端分别由二个锁存器（74LS373）锁存，锁存器

的输入连至数据总线，数据开关（“INPUTDEVICE”）用来给出参与运算的数据，

并经过一三态门（74LS245）和数据总线相连，数据显示灯（“BUSUNIT”）已和

数据总线相连，用来显示数据总线内容。

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图1－1运算器数据通路

图中已将用户需要连接的控制信号用圆圈标明（其他实验相同，不再说明），

其中除T4为脉冲信号，其他均为电平信号。由于实验电路中的时序信号均已连

至“W/RUNIT”的相应时序信号引出端，因此，在进行实验时，只需将“W/RUNIT”

的T4接至“STATEUNIT”的微动开关KK2的输出端，按动微动开关，即可获得

实验所需的单脉冲，而S3、S2、S1、S0、Cn、M、LDDR1、LDDR2、ALU-B、SW-B

各电平控制信号用“SWITCHUNIT”中的二进制数据开关来模拟，其中Cn、ALU-B、

SW-B为低电平有效，LDDR1、LDDR2为高电平有效。

三、实验内容

1、按照图1-2连接实验线路，仔细查线无误后，接通电源。

图1－2实验连接图

2、用二进制数码开关向DR1和DR2寄存器置数。具体操作步骤图示如下：

数据开关三态门寄存器DR1数据开关寄存器DR2

ALU-B=1LDDR1=1LDDR1=0

SW-B=0LDDR2=0LDDR2=1

T4=T4=

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检验DR1和DR2中存的数据是否正确，具体操作为：关闭数据输入三态门（SW-B

＝1），打开ALU输出三态门（ALU-B＝0），当置S3、S2、S1、S0、M为11111时，

总线指示灯显示DR1中的数，而置成10101时总线指示灯显示DR2中的数。

3、验证74LS181的算术运算和逻辑运算功能（采用正逻辑）

在给定DR1＝65、DR2＝A7的情况下，改变运算器的功能设置，观察运算器的

输出，填入下表1-1中，并和理论分析进行比较、验证。

表1－1

M=0（算术运算）

M=1

DR1DR2S3S2S1S0Cn=1Cn=0