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基于FPGA实现FIR数字滤波电路的设计及应用
（最新版）
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审批人：__________________
编制单位：__________________
编制时间：____年____月____日
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车辆在动态称重时，作用在平台上的力除真实轴重外，
还有许多因素产生的干扰力，如：车速、车辆自身谐振、路
面激励、轮胎驱动力等，给动态称重实现高测量造成很
大困难。若在消除干扰的过程中采用模拟方法滤波，参数则
不能过大，否则将产生过大的延迟导致不能实现实时处理，
从而造成滤波后的信号仍然含有相当一部分的噪声。所以必
须采用数字滤波消除干扰。
FIR滤波的原理及实现
本文采用FIR数字滤波，其原理如公式1所示。
Y（n）=（1）
其中h（k）为系统滤波参数，x（n）为采集的信号，Y
（n）为滤波后的输出信号。
FIR滤波器的h（n）0≤n≤N-1
H（z）=（2）
在本文中N=17。由于h（n）具有对称性质，即：
h（n）=h（N-1-n）（n=0，1，。..，（N-1）/2）（3）
这样就可以把FIR滤波器设计成具有线性相位。利用这
一情况，可以得到的乘法结构，需要（N+1）/2次乘法，仅
是级联或并联结构所需次数的一半，因此，实际应用中多采
用此方法。
我们选用17点的FIR滤波算法，这样实现FIR卷积
运算需要执行9次乘法和16次加法。为了实现数据的实时
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处理，需要在20ms内完成这个卷积运算，如果选用单片机
89C51（12M晶振）则无法实现。所以我们选用了Altera公
司的FLEX10K20。FLEX10K系列是工业界个嵌入式的PLD，
采用重复可构造的CMOSSRAM工艺，把连续的快速通道互连
与独特的嵌入式阵列结构相结合，同时也结合了众多可编程
器件的优点来完成普通门阵列的宏功能。具有高密度、低成
本、低功率等特点。
图1硬件结构框图硬件设计
由于我们选用的AD1674芯片转换时间为10ms，而所设
计的电路每隔20ms启动转换，所以有足够的时间完成模
数转换。轴重台的宽度为40cm，汽车通过轴重台的速度
为15km/h，通过计算可知在这段时间里系统可采集4800个
数据。由于前30ms是传感器的反应时间，将剩下的数据进
行FIR数字滤波后，噪声会被有效的抑制。为了进一步平滑
波形，对每8个数据做平均，这样就消弱了由于汽车高
速通过轴重台时由于颠簸产生的尖峰信号。FPGA的每次滤波
包含有FIR运算和8个数据的平均值运算，完成滤波就
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会向单片机发一个中断请求，此时单片机读取滤波后的数
据。由于我们选用的A/D转换器是1
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