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数字电子技术基础
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北京交通大学电子信息工程学院
第四节同步时序逻辑电路的设计
同步时序逻辑电路的设计
是根据电路逻辑功能要求，使
用触发器和门电路，设计同步
时序逻辑电路。
第四节同步时序逻辑电路的设计
设计步骤:给定逻辑功能
建立原始状态图、原始状态表
状态简化，求最小化状态表
状态编码
选触发器类型，求驱动方程、输出方程
画逻辑电路图
画全状态图，检查设计，如不符合要求，重新设计
第四节同步时序逻辑电路的设计
例：设计一个序列检测器，当输入011码时电路输出为1，否则输出为0。
解：1.画出原始状态图与原始状态表
输入端X：输入一串行随机信号；
输出端Z：当X出现011序列时，Z=1；否则Z=0。
S/Z
n+1
0/0X
1/00/001
ABSn
AB/0A/0
1/00/01/0
0/0BB/0C/0
DCCB/0D/1
1/1
DB/0A/0
第四节同步时序逻辑电路的设计
2.状态化简
输入相同时，对应的输出和次态均相同，称作状态等价。
等价状态可以合并为一个状态。
X
01
S
nX
S01
n
AB/0A/0
AB/0
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