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四、简答题

、与HDL文本输入法相比较，原理图输入法有何优点？

1：设计者不需增加新的相关知识，如HDL等。

2：输入方法与用protel作图相似，设计过程形象直观，适合初学者入门。

3：对于较小的电路模型，其结构与实际电路十分接近，设计者易于把握电

路全局（适合设计小型数字电路）。

4：设计方式接近于底层电路布局，因此易于控制逻辑资源的耗用，节省面

积。

2、写出结构体的一般语言格式并说明其作用

ARCHITECTURE结构体名OF实体名IS

[说明语句]

BEGIN

[功能描述语句]

ENDARCHITECTURE结构体名;

结构体用于描述电路器件的内部逻辑功能或电路结构。使用的语句有顺序语句和

并行语句。

3、信号和变量的区别？

（1）信号赋值至少有δ延时，而变量赋值没有延时。

（2）信号除当前值外有许多相关的信息，而变量只有当前值。

（3）进程对信号敏感而对变量不敏感

（4）信号可以是多个进程的全局信号；而变量只在定义它们的顺序域可见。

（5）信号是硬件中连线的抽象描述，它们的功能是保存变化的数据和连接子元

件，信号在元件的端口连接元件。变量在硬件中没有类似的对应关系，它们用于

硬件特性的高层次建模所需要的计算中。

（6）信号赋值和变量赋值分别使用不同的赋值符号“=”和“：=”，信号类型

和变量类型可以完全一致，也允许两者之间相互赋值，但要保证两者的类型相同

4、写出PROCESS语句结构的一般表达格式。

[进程标号:]PROCESS[(敏感信号参数表)][IS]

[进程说明部分]

BEGIN

顺序描述语句

ENDPROCESS[进程标号];

5、写出五种以上的VHDL的预定义数据类型。

布尔(BOOLEAN)数据类型、位(BIT)数据类型、位矢量(BIT_VECTOR)数据类型

字符(CHARACTER)数据类型、整数(INTEGER)数据类型、实数(REAL)数据类型

字符串(STRING)数据类型、时间(TIME)数据类型

1、简叙EDA的FPGA/CPLD设计流程。

答：（1）进行原程序的编辑和编译.

（2）逻辑综合。

（3）目标器件的布线/适配。

（4）目标器件的编程/下载。

（5）硬件仿真/硬件测试。

2、简述VHDL程序的基本结构:？

一个完整的VHDL程序（或称设计实体）具有比较固定的结构，它至少包括

库、程序包、实体说明和结构体说明。其中，库、程序包用于打开设计实体将要

用到的库和程序包；实体用于该设计实体与外界的接口信号说明，是可视部分；

结构体用于描述该设计实体内部工作的逻辑关系，是不可视部分。

3、元件例化语句的作用是什么？

答：元件例化语句就是先将设计好的设计实体定义为一个元件，然后引用特定的

语句将此元件与当前的设计实体中的指定端口连接，从而为当前设计实体引入一

个新的低一极的设计层次。元件例化使VHDL设计实体构成自上而下层次设计的

一个重要途径。元件例化可以是多层次的。

4、VHDL子程序有什么作用？它有哪两种方式

答：VHDL子程序是一个VHDL程序模块，它利用顺序语句来定义和完成算法的。

应用它可以更有效地完成重复的设计工作。子程序不能从所在的结构体的其它块

或进程结构中直接读取信号值或者向信号赋值，而只能通过子程序调用及子程序

的界面端口进行通用。

子程序有两种类型：过程和函数。

5、说明BIT和STD_LOGIC类型的区别，为什么STD_LOGIC类型要取多种值。

答:BIT数据类型取值只能是0和1，其可参与逻辑运算，运算结果仍是BIT数

据类型。STD_LOGIC标准逻辑类型是BIT类型的扩展，其取值共有9种值。因为

通常在应用设计中与已有的元件兼容。

1.VHDL程序的组成部分包含哪些内容？其中哪几部分是VHDL程序必不可少的？

答：VHDL程序的组成部分包含：实体（Entity）、结构体（Architecture）、程

序包（Package）、库（Library）。（4分）

其中，实体（Entity）、结构体（Architecture）是VHDL程序必不可少的（1

分）

2．顺序语句和并行语句有什么区别？VHDL编程中需要注意些什么？

答：并行语句主要有一般信号赋值