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实验八计数器设计
一、实验目的
1、掌握计数器电路设计的方法。
2、能够通过CPLD开发实现时序逻辑电路的功能。
二、实验内容
（1）设计一个同步带有进位输出端的十进制显示，模为24的计数器，且能够
自启动。要求如下：
○用原理图输入法，元件采用74160设计上述计数器，并硬件下实现，结
1
果用数码管显示。
○用文本输入法设计编程，并硬件下实现，结果用数码管显示。
2
（2）用综合方法设计一个计数器，要求：
○用原理图输入法，元件采用74160设计上述计数器，并硬件下实现，结
1
果用数码管显示。
○用文本输入法设计编程，并硬件下实现，结果用数码管显示
2
三、实验逻辑功能分析及预习情况
（1）数码管真值表如下：
数字输入输出
X3X2X1X0YaYbYcYdYeYfYg字形
0000011111100
1000101100001
2001011011012
3001111110013
4010001100114
5010110111115
6011010111116
7011111100007
8100011111118
9100111110119
1010101110111A
1110110011111B
1211001001110C
1311010111101D
1411101001111E
1511111000111F
（2）模24计数器真值表
输出
数字
Q5Q4Q3Q2Q1Q0
000000
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