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JESD204B子类(第一部分)：
早在此版本发布以前，需要确定性延迟的系统设计人员便
JESD204B子类简介与确定性延已采用外部应用层电路来实现该要求。
迟确定性延迟概述JESD204B标准将确定性延迟(DL)定义为
基于帧的样本到达串行发送器的时间与基于帧的样本从串
作者：DelJones，ADI公司高速转换器部门应用工程行接收器输出的时间之差。延迟在帧时钟域中测量，且至
师少在低至帧时钟的周期内必须是增量可编程的。延迟必须
简介毫无疑问，信息时代的标志是收集、处理和分发越来在两次上电周期之
越大的数据块的需求呈现爆炸式的增长。在通信网络领域，间，以及任意再同步事件之间可以重复。此定义见图1。
这意味着网络上连接的基础设施和组件需要更多带宽。在
医疗行业，这表现为来自扫描仪、X射线仪和其他设备的
信息更为详细。相应地，对带宽的这种快速增长进行测试
与分析便意味着需要使用速度更快、容量更大的电子测试
设备。图1.确定性延迟图示
JESD204系统中的确定性延迟由固定延迟和可变延迟
这种对数据的无止境需求导致JEDEC发布了针对数据转
组成。可变延迟是由数字处理模块中时钟域之间逐电源周
换器与逻辑器件之间高速串行链路的JESD204标准。该
期的任意相位关系所导致。在JESD204A和JESD204B子
标准的修订版B于2011年发布，此版本将串行链路数
类0系统中未考虑到可变延迟。因此链路上的电源周期变
据速率提高到了12.5Gbps，以满足当今世界基于转换器应
化存在延迟。
用的更高带宽要求。这些应用中的很大一部分都要求数据
以两次电源周期之间已知且一致的延迟遍历整个系统。这子类0
一概念称为确定性延迟“”，JESD204B标准对此要求同样子类0主要由JESD204B标准所提供，以保证向后兼
有相关规定。容JESD204A器件。如果系统设计人员有一个带有
此版本发布前，需要实现确定性延迟的系统设计人员使用传统JESD204A接口的自定义ASIC，并希望将其连接至带
有最新特性的JESD204B转换器，那么很可能需要这种向后
外部应用层电路来满足要求。在JESD204B标准中引入了
兼容性。
三个子类。子类0向后兼容JESD204A标准，并且没有
JESD204B标准要求JESD204B标准提供子类0工作模
关于执行确定性延迟的相关规定。子类1引入了一个外
部参考信号(称为SYSREF)，该参考信号为采样时序提供式的要求和建议；这些要求可能与其他子类有所不同。最
了一个系统级的基准。子类2定义SYNC~信号如何用作明显的就是，SYNC~信号的要求是子类1独有的。
采样时序的系统级基准。
采样时序基准在各种情况下均可用来实现确定性延迟。本
迷你指南“”旨在厘清JES
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