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例4.1解:(1)写出对应的二进制地址码(2)确定芯片的数量及类型0110000000000000A15A14A13A11A10…A7…A4A3…A0…01100111111111110110100000000000…01101011111111112K×8位1K×8位RAM2片1K×4位ROM1片2K×8位4.2(3)分配地址线A10~A0接2K×8位ROM的地址线A9~A0接1K×4位RAM的地址线(4)确定片选信号CBA0110000000000000A15A13A11A10…A7…A4A3…A0…01100111111111110110100000000000…01101011111111112K×8位1片ROM1K×4位2片RAM4.22K×8位ROM1K×4位RAM1K×4位RAM………PD/ProgrY5Y4G1CBAG2BG2A……MREQA14A15A13A12A11A10A9A0…D7D4D3D0WR…………例4.1CPU与存储器的连接图4.2………(1)写出对应的二进制地址码(讲)例4.2假设同前,要求最小4K为系统程序区,相邻8K为用户程序区。(2)确定芯片的数量及类型(3)分配地址线(4)确定片选信号1片4K×8位ROM2片4K×8位RAMA11~A0接ROM和RAM的地址线4.2例4.3设CPU有20根地址线,8根数据线。并用IO/M作访存控制信号。RD为读命令,WR为写命令。现有2764EPROM(8K×8位),外特性如下:用138译码器及其他门电路(门电路自定)画出CPU和2764的连接图。要求地址为F0000H~FFFFFH,并写出每片2764的地址范围。4.2…D7D0CEOECE片选信号OE允许输出PGM可编程端PGM…A0A12六、存储器的校验(不讲)编码的纠错、检错能力与编码的最小距离有关L——编码的最小距离D——检测错误的位数C——纠正错误的位数汉明码是具有一位纠错能力的编码4.2L1=D+C(D≥C)1.编码的最小距离任意两组合法代码之间二进制位数的最少差异L=3具有一位纠错能力七、提高访存速度的措施地址寄存器采用高速器件调整主存结构1.单体多字系统W位W位W位W位W位主存控制器......单字长寄存器数据寄存器存储体采用层次结构Cache–主存增加存储器的带宽4.2转移指令?2.多体并行系统(1)高位交叉M0……M1……M2M3…………4.2体内地址体号体号地址000000000001001111010000010001011111100000100001101111110000110001111111顺序编址(1)高位交叉各个体并行工作4.2M0地址01……n-1M1nn+1……2n-1M22n2n+13n-1M33n3n+14n-1…………地址译码体内地址体号体号使用场合:多CPU共享内存编制(2)低位交叉M0……M1……M2M3
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