Verilog Demo例程时序说明.pdfVIP

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目录

1.同步信号及同步头1

1.1同步头1

1.2行同步信号1

1.3场同步信号1

2.像素点信号2

3.行信号3

4.场信号4

同步信号及同步头

如图1-1所示,无论是场同步信号还是行同步信号,它们的“结构”都类似,都是由

同步头和有效信号组成的。

1.1同步头

图1-1中红色的部分即为同步头,由同步头前沿、同步头脉冲和同步头后沿组成。

图1-1同步信号及同步头

1.2行同步信号

其组成如图1-1所示,同步头部分先不予解释,后面将会提到。这里的有效信号

指的是有效的像素点信号(RGB)信号,以800*600分辨率(60Hz)为例,在这个区间内,应该

连续发送800个有效的RGB数据。

1.3场同信

与行同步信号类似的结构类似,其组成如图1-1所示,同步头部分先不解释,后面也

会提到。这里的有效信号指的是有效的行信号,以800*600分辨率(60Hz)为例,在这个

区间内,应该连续发送600个行信号。

2.点信号

其实VGA接口并没有时钟信号,图2-1中的时钟信号是处理器运算时候的时序依

据,这个时钟信号与VGA显示器的刷新频率有关,所以它很重要。由于VGA接口的R、G、

B信号为模拟信号,所以要将处理器生成的数字信号转换为模拟信号,具体的实现方法有很

多,不是这里重点介绍的,所以不多说,读者可以自己查资料。

图2-1像素点信号

3.行号

如图3-1所示,一个完整的行信号是由行同步信号和RGB信号组成的,具体内容大家

还是看图吧,很详细了。其实一个行信号,就是点亮显示器的某一行,即发送完一个行信号

就点亮一行,发送两个行信号就点亮两行,依此类推。如果是800*600的分辨率(刷新频率

为60Hz),一个行信号里要包含800个RGB信号(当然还有别的信号,看图)。

图3-1一个完整的行信号解析

4.场号

如图4-1所示,一个场信号是由若干行同步信号和有效的行信号组成的,具体的请看

图,很详细。如果是800*600的分辨率(刷新频率为60Hz),就要发送600个行信号(当然还

有别的信号,看图)。

图4-1一个完整的场信号解析

分更辨多率关的于信息VG,A请参考。

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