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数字电路的FPGA设计与实现——基于Quartus Prime和Verilog HDL-第6讲-基于HDL的简易数字系统设计.pptx

数字电路的FPGA设计与实现——基于Quartus Prime和Verilog HDL-第6讲-基于HDL的简易数字系统设计.pptx

    第6讲-基于HDL的简易数字系统设计

    1

    数字电路的FPGA设计与实现

    ——基于QuartusPrime和VerilogHDL

    FPGADesignandImplementationofDigitalCircuits

    ——BasedonQuartusPrimeandVerilogHDL

    2

    简易数字系统电路图

    3

    使用Quartus集成开发环境自带的门电路，基于VHDL设计的简易数字系统电路图如下图所示，输入为A和B，非门输出为Y1、与门输出为Y2、与非门输出为Y3、或门输出为Y4、或非门输出为Y5、异或门输出为Y6。

    模块（module）语法结构

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