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器件与应用
文章编号： （ ）
１００２－８６９２ ２００8 12-0032-03
实用技术
一种高效 编解码器的 实现 · ·
RS FPGA
李晓飞 牟崧友
，
南京邮电大学 通信与信息工程学院 江苏 南京
（ ， 210003 ）
摘 要 提出了一种实现复杂度低 高效率的 编解码器的 实现电路 整个 设计分为 编码器
【 】 、 （ ， ） 。 、
RS 204 188 FPGA FPGA RS Horner
准则的伴随式计算 改进的 算法 搜索求根和 算法求差错幅值等 个模块 同时 总体电路采用了 结构
、 BM 、Chien Forney 5 ， ， pipeline ，
有效提高了译码速率 选用 公司的 系列 芯片 译码时延 个时钟周期 使用 资源 门
。 Xilinx Spartan3E XC3S500E ， 242 ， FPGA 186 000 ，
译码性能与理论值一致 已用于特定无线图像传输系统
， 。
关键词 码 现场可编程门阵列 改进 算法 搜索 算法
【 】 Reed-Solomon ； ； BM ；Chien ；Forney
【中图分类号】 TN762 【文献标识码】 A
Implementation of High Efficiency RS Codec Based on FPGA
LI Xiao-fei ， MU Song-you
（College of Telecommunication and Information Engineering ， Nanjing University o
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