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CPLD 在通信数据传输中的应用 The Application of CPLD in Digital Transmissions 王红燕 摘要：提出了一种利用CPLD有效解决通信数据传输问题的方案，详细分析了CPLD在 系统中的作用、工作原理和设计方法，并给出仿真以及实测结果，结果证实了此种方案的 可行性和优越性。 关键词：CPLD 双口RAM 数据传输 OMAP AD9861 Abstract: This article introduces a kind of design options about digital transmission with CPLD, analyses the significance of CPLD, the principle, and the detailed scheme. The simulation result and test result are presented as well, which proves the feasibility and superiority of the scheme. 1 概述 随着大规模集成电路和单片机的迅速发展，复杂可编程逻辑器件（CPLD ）具有使用灵 活、可靠性高、功能强大的优点，在电子产品设计中得到了广泛的应用。CPLD 可实现在系 统编程，重复多次，而且还兼容 IEEE1149.1(JTAG)标准的测试激励端和边界扫描能力，使 用 CPLD 器件进行开发，不仅可以提高系统的集成化程度、可靠性和可扩充性，而且大大 缩短产品的设计周期。由于 CPLD 采用连续连接结构，易于预测延时，从而使电路仿真更 加准确。CPLD 是标准的大规模集成电路产品，可用于各种数字逻辑系统的设计。近年来， 随着采用先进的集成工艺和大批量生产，CPLD 器件成本不断下降，集成密度、速度和性 能都大幅度提高，这样一个芯片就可以实现一个复杂的数字电路系统；再加上使用方便的开 发工具，给设计修改带来很大方便。 实验室设计开发了一款无线数据接收平台，上下行速率可以达到 1Mbps。射频部分采用 了 Maxim 的射频套片，基带部分采用了 OMAP 平台，基带射频接口采用了 ADI 公司的混 合信号前端（MxFE™ ）基带传输芯片 AD9861 ，系统的逻辑控制和数据的缓冲采用了 ALTERA 的CPLD EPM240GT100C3 。 2 EPM240GT100C3 实现的功能与总体要求 EPM240GT100C3要完成AD9861 的时序控制、AD9861和OMAP之间的数据缓存以及提 供网口芯片LAN91C93所需的控制信号。在这几项功能中，最主要的是数据缓存功能。要 想正确地实现缓存功能，就必须要求缓存的收发I、Q数据不丢失，不颠倒，不错相，同 时保证数据的先写后读。按照这样的思想，再结合两边的接口时序正确地配置读写地址、 读写时钟，就可以完成所需功能。 3 CPLD 程序的详细设计 CPLD的主要功能是完成数据缓存和一些时钟控制信号的产生。其功能框图如图1所 示，主要包括双口RAM存储体单元，时钟和控制信号产生单元，OMAP侧地址发生单元， AD9861侧地址发生单元。 图 1 CPLD 功能框图 3.1 双口 RAM 的设计方法 因为OMAP和AD9861两边都有读写操作，于是选择了双口RAM （DPRAM ）作为数据 的缓存。由于CPLD 内部的逻辑资源和布线资源有限，并且没有独立的DPRAM区，只能 用DFF来完成缓存功能，这就限制了DPRAM 的大小。因为系统要求每个DMA 中断读写8 个数据，为了减小读写冲突的可能性，同时尽量地降低FF资源的利用，最终采用了相当 于两个8 ×8大小乒乓缓冲的16×8双口RAM缓冲区。DPRAM 的外部接口如图2所示： 图2 DPRAM 的外部接口 其中dina和douta接OMAP的数据线，dinb和doutb接AD9861 的数据线，addra和addrb为 内部产生的读写地址。Wr_rd_en控制读写的方向，和TX_RX相连，即当Wr_rd_en ＝’1’时， 为发射，数据由OMAP写入，AD读出，数据流向从dina －doub;