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实验一 MAX+PLUSⅡ软件的使用 实验目的： 学习VHDL语言的基本指令及编程方法。 熟悉在PC机上运用MAX+PLUSⅡ软件和EPLD进行电路设计的设计和仿真过程。 实验设备：PC机 实验内容： 设计一个2选1数据选择器，并验证其功能。用VHDL语言进行设计，并仿真设计结果。真值表如下所示： a b s y 0 0 0 0 0 1 0 1 0 1 1 1 1 0 0 1 0 0 1 1 1 0 0 1 1 1 用VHDL语言输入法设计一个四舍五入判别电路，其输入为8421BCD码，要求当输入大于或等于5时，判别电路输出为1；反之为0。 实验步骤： （一）2选1数据选择器的设计 采用文本编辑器输入2选1数据选择器VHDL语言源程序，建立工程。VHDL语言源程序如下所示： library ieee; use ieee.std_logic_1164.all; entity mux21 is port(a,b: in std_logic; s: in std_logic; y: out std_logic ); end mux21; architecture mux_arch of mux21 is begin y=a when s=0 else b when s= 1; end mux_arch; 进行编译后，仿真结果如下所示： a、b为输入端，s为控制端，当s为0时，输出与a的值一致，反之与b的值一致。 （二）四舍五入判别电路的设计 1、采用文本编辑器输入四舍五入判别电路VHDL语言源程序，建立工程。VHDL语言源程序如下所示： LIBRARY IEEE; USE IEEE.STD_LOGIC_1164.ALL; USE IEEE.STD_LOGIC_UNSIGNED.ALL; ENTITY m45 IS pORT(din: IN STD_LOGIC_VECTOR(3 DOWNTO 0); q : OUT STD_LOGIC); END ; ARCHITECTURE ART OF m45 IS BEGIN q= 1 WHEN din=5 ELSE 0; END ; 进行编译后，仿真结果如下所示： 输入为0~4时，输出y为低电平，输入为5~15时输出为高电平，实现了四舍五入的功能。 2进制表示： BCD码表示： 五、心得体会 通过这次实验我认识到在做实验前,一定要将课本上的知识吃透,因为这是做实验的基础,否则就不会编程。,这将使你在做实验时的难度加大,浪费做实验的宝贵时间。本来我的基础也不是很扎实，所以编程对我来说，需要花更多的时间去调试。最后能够把结果在仿真中体现出来，这样使我对原来课本的知识更加熟悉，并且加以巩固。 3