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2017-08-17 发布于贵州
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基于CPLD_FPGA的CMI编码设计与实现.pdf

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: CPLD /FPGA CMI 基于CPLD /FPGA 的CMI 编码设计与实现李莉 ( , 710061) : 根据CMI 码的特性, 介绍了一种新的编程思路实现 CM I 编码, 在Max + Plus 开发平台上使用 V HDL 编程实现CMI 编码, 并得到真波形实验结果表明, 这种编程思路简单清晰在产生7 位伪随机序列的前提下, 分别对0, 1 进行编码这种思路为其他码型设计提供了参考 : 通信原理; V HDL ; CMI; Max + Plus : T P274 : A : 1004373X( 2010) Design and Implementation of CMI Coding Based on CPLD/ FPGA LI Li ( D part m nt of T l communicat ion Engin ring, Xian Inst it ut of Posts and T l communications, Xi an 710061, China) Abstract: A n w programming id a of which V HDL programming is us d to achi v CMI coding on th platform of Max plus is introduc d according to th charact ristics of CM I cod , and th simulation w av forms ar achi v d. Th r sults in dicat that this m thod is simpl and cl ar. 0,1ar ncod d in th pr mis of g n rating 7 b ps udorandom s qu nc . This m thod provid s a r f r nc for oth r d sign of cod typ . Keyw ords: communicat ion principl ; VH DL ; CMI; Max + Plus CMI , 0 01 , 0 1 , CM I CM I , 00 11 , 1 [ 2] PCM , , , [ 1] 2 CMI , , M UX_Clk , 8 448 Kb/ s Clk[ 3] , 2 , 3 D 7 CM I [ 4] , 1 , EPM 7064 , M ax + Plus , VHDL , CPLD CM I 1 CMI CM I 1 1 CMI 输入码字编码结果图1 7 位伪随机