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基于FPGA的直接数字频率合成系统的仿真设计.pdf
第 卷 第 期 软 件 导 刊
7 9 Vol.7No.9
年 月
2008 9 SoftwareGuide Sep.2008
基于FPGA的直接数字频率合成系统的仿真设计
朱小祥
(武汉软件工程职业学院 电子系,湖北 武汉 )
430000
摘 要:利用 系统工具的模拟功能对电路过程进行仿真,花费少,效率高。介绍了利用 设计一基于
EDA Multisim9 FPGA
的直接数字频率合成系统的全过程。
关键词: ;直接数字频率合成;波形存储器;数模转换模块;
Multisim9 FPGA
中图分类号: 文献标识码: 文章编号: ( )
TP15 A 1672-7800200809-0124-03
形功能。
0 引言 基本原理及其性能特点
1.2.1 DDS
的基本原理示意如图 所示。相位累加器由 位加法器
DDS 1 N
( )技术已经在电子设计
EDAElectronicDesignAutomation
与 位累加寄存器级联构成。每来一个时钟脉冲 ,加法器将频
N fs
领域得到广泛应用,发达国家目前已经基本上不存在电子产品
率控制字 与累加寄存器输出的累加相位数据相加,把相加后
k
的手工设计。一台电子产品的设计过程,从概念的确立,到包括
的结果送至累加寄存器的数据输入端。累加寄存器将加法器在
电路原理、 版图、单片机程序、 的构建及仿真、电磁兼
PCB FPGA
上一个时钟脉冲作用后所产生的新相位数据反馈到加法器的
容分析等在内的物理级设计,再到 钻孔图、元器件清单、总
PCB
输入端,以使加法器在下一个时钟脉冲的作用下继续与频率控
装配图等生产所需资料等,全部在计算机上完成。EDA技术借
制字相加。这样,相位累加器在时钟作用下,不断对频率控制字
助计算机存储量大、运行速度快的特点,可对设计方案进行人
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