3线路至8线路解码器多路解复用器 (3-LINE TO 8-LINE DECODERSDEMULTIPLEXERS).pdfVIP

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3线路至8线路解码器多路解复用器 (3-LINE TO 8-LINE DECODERSDEMULTIPLEXERS).pdf

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3线路至8线路解码器多路解复用器 (3-LINE TO 8-LINE DECODERSDEMULTIPLEXERS).pdf

54AC11238, 74AC11238 3-LINE TO 8-LINE DECODERS/DEMULTIPLEXERS SCAS039A – APRIL 1988 – REVISED APRIL 1993 • Designed Specifically for High-Speed 54AC11238 . . . J PACKAGE Memory Decoders and Data Transmission 74AC11238 . . . D OR N PACKAGE Systems (TOP VIEW) • Noninverting Version of ′AC11138 Y1 1 16 Y0 • Incorporates 3 Enable Inputs to Simplify Y2 2 15 A Cascading and/or Data Reception Y3 3 14 B • Flow-Through Architecture Optimizes GND 4 13 C PCB Layout Y4 5 12 VCC • Center-Pin VCC and GND Configurations Y5 6 11 G1 Minimize High-Speed Switching Noise Y6 7 10 G2A • EPIC (Enhanced-Performance Implanted Y7 8 9 G2B CMOS) 1-m Process • 500-mA Typical Latch-Up Immunity at 125°C 54AC11238 . . . FK PACKAGE (TOP V

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