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9位奇偶发生器 跳棋 (9-BIT PARITY GENERATORS CHECKERS).pdf
SCAS046A − D3148, AUGUST 1988 − REVISED APRIL 1993
• Inputs Are TTL-Voltage Compatible 54ACT11280 . . . J PACKAGE
74ACT11280 . . . D OR N PACKAGE
• Generates Either Odd or Even Parity for
(TOP VIEW)
Nine Data Lines
• Cascadable for n-Bits Parity B 1 14 C
• Flow-Through Architecture Optimizes A 2 13 D
PCB Layout Σ ODD 3 12 E
• Center-Pin VCC and GND Configurations GND 4 11 VCC
Minimize High-Speed Switching Noise Σ EVEN 5 10 F
NC 6 9 G
• EPIC (Enhanced-Performance Implanted
I 7 8 H
CMOS) 1-m Process
• 500-mA Typical Latch-Up Immunity
54ACT11280 . . . FK PACKAGE
at 125°C
(TOP VIEW)
• Package Options Include Plastic
C
Small-Outline Pac
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