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计数器型控制器设计 （7）画控制器电路图??? * 加法运算器结构 用Mux 写激励函数 * 状态转移表 * 想一想? 若ASM流程图如下, 控制器设计如何? * 计数器型控制器设计 CLR’─寄存器C清零信号（电位) LDA─寄存器A打入信号（脉冲） LDB─寄存器B打入信号（脉冲) ADD─加法器使能信号（电位) （3）编码的ASM流程图 列出状态转移表 * 计数器型控制器设计 写出控制命令, 根据ASM流程图 LDA信号在00和11状态出现 故 LDA=(B ’A’+ B A ) LDB在01和10状态出现 故 LDB=(BA’+B’A)=(B⊕A) ADD信号在10状态出现.故 ADD=B A’ CLR’信号在00状态出现. 故CLR’=B’ A’ ADD, CLR’为电位信号, 持续时间为状态周期 T=T1+T2 T1为控制器计数器的时钟方波. 修正后 LDA =(B ’A’+ B A ) T2 LDB=B⊕A)T2 考虑 LDA，LDB是脉冲信号，设 T2 为正脉冲，上升沿有效。 * 6）画出控制器电路图??? 加法运算器结构 激励方程 * 想一想? 若用JK触发器, 激励方程如何? QB=QA=QA(QB+Q’B) QA=Q’B(QA+Q’A) * QB=QA=QA(QB+Q’B) QA=Q’B(QA+Q’A) JB=QA KB=Q’A JA=Q’B KA=QB 激励方程 * * * 化简后的系统框图 通路开关：可用三态缓冲器代替 。 4 根据系统框图，编制控制算法： B=A+B * 控制算法: 控制器对执行部件的控制关系。以某种状态流程图方式来表达。 * 控制算法1 CLR C LDA LDB LDA ADD LDB * 根据系统框图，控制算法2为： （ 返回到S2， 反复累加） （ 返回初始状态S0） 控制算法 算法状态机（ASM ,Algorithmic State Machine ） 一种描述控制算法的有效方法。可以表示数字系统的时序操作,并实现它的硬件(控制器). ASM本质上是一个时序状态机，定义了整个数字系统。 控制器对执行部件的控制关系。以某种状态流程图方式来表达，使其转换成实现它的硬件。 * 算法状态机 与时序状态机相比，ASM有如下特点： ASM以流程图形式描述控制器功能、状态变化及条件、状态转换的时间,指明了寄存器具体操作; ASM是时钟驱动的流程图。不是事件驱动的流程图； ASM不仅描述控制器控制过程（控制器状态转换、转换条件及控制输出）也指明被控部件的应有操作; ASM适用于同步系统。 可方便地实现或设计硬件控制器。 * * 1. ASM的符号表示(ASM图) ASM图由三个基本图形符号组成：状态框、判断框和条件输出框，如下图所示。 ASM的基本图形符号 * ASM流程图的基本图形 状态框： 有进口和出口的矩形框， 代表系统一个状态。状态框内定义此状态实现的寄存器操作和输出。 状态经历的时间用状态时间表示，同步系统中状态时间为一个同步时钟周期。 状态名写在框外左上方，状态编码写在框外右上方。 操作内容写在矩形框内。 条件判断框： 简称分支框，用单入口多出口的菱形或多边形表示。 框内写检测条件，判别可以是状态变量或输入变量；个数不限； 判别变量的作用可以同等，也可以有优先级。出口处注明各分支所满足的条件。 条件判断框不占用时间.经历时间依附于状态框。 * 判断条件 判断条件 条件输出框： 由平行四边形组成。入口来自某一分支，某些条件满足时，给出指定的输出，输出操作内容写在框内。 注意：条件输出框不是控制器的一个状态。不占用时间,它经历的时间依附于状态框。 * 输出内容 状态单元： 由一个状态框、若干条件判断框或条件输出框组成（上述三种图形的组合） ?? 状态单元入口是状态框入口，出口指向状态框（可以有多个）。 状态单元经历的时间为状态框时间。 状态单元典型结构如下 * 寄存器输出 条件输出 * 状态机有S0、S1两个状态。??? 当S0时，如检测条件满足X=0，则仍在S0状态； 如果满足X=1，则转向S1状态。??? 当S1时，如检测条件满足X=0，则仍在S1状态； 如果满足X=1，则由转向S0状态，输出Z=1 对应的ASM流程图见图(b)所示。 ??? 【例6】 将图（a）所示