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题目：实验一 简单逻辑电路实验 教学目的要求： 运用Quartus II 集成环境下的VHDL文本设计方法设计半加器，进行波形仿真、引脚分配并下载到实验设备上进行逻辑功能验证，并分析其波形。 教学重点、难点： 重点：Quartus II 软件平台和使用 VHDL 语言设计电路的方法 难点：波形仿真、分析 教学方式、手段、媒介： 讲授、多媒体、示范 教学过程： 一、实验目的 学习Create-SOPC实验平台的使用方法； 熟悉Quartus II 软件平台和使用 VHDL 语言设计电路的方法； 学习简单逻辑电路的设计、仿真和硬件测试。 二、实验内容 运用Quartus II 集成环境下的VHDL文本设计方法设计半加器，进行波形仿真、引脚分配并下载到实验设备上进行逻辑功能验证。 三、实验步骤及参考程序 EDA实验箱介绍和使用 创建个人实验文件夹(最好使用英文字母命名不要用中文或数字名称)如：D:\example 运行 Quartus Ⅱ软件。 创建一个VHDL设计文件：File － New，在 Device Design Files 中选择VHDL File。在程序编辑窗输入VHDL程序并保存；在弹出对话框中输入文件名（必须和程序中实体名相同）并使下方小框内出现“√”，点击保存会弹出“是否创建新工程”提示信息如图1-1所示。 图1-1