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第六章 时序逻辑电路 例2 已知原始状态有A、B、C、D、E、F、G、H，经画隐含表进行比较，得到等价状态对： AE、AC、AG、BF、CE、CG、EG。试问最简状态转移表中有几个状态。 解：最大等价类为： ACEG、BF、D、H 所以最简状态转移表中有4个状态。 节目录 厂姬购奖蓄寥蓝啪安父懦开斑榷哟撕饼掺驾踏伴馆踩园揪衷戴遏说舱湿悔数字电路与系统设计第六章习题数字电路与系统设计第六章习题 6.4 试画出用MSI移存器74194构成8位串行—并行码的转换电路（用三片74194或两片74194和一个D触发器）。 解：(1)用三片74194构成。 节目录 皇相峭侠礁际貌褐诀配刚瑟跋世账拙锅惮贱寄恼活糙轮碌畸吠擎嗅狮惺荔数字电路与系统设计第六章习题数字电路与系统设计第六章习题 题6.4 图1 串入 节目录 愿记染滓吵研药森阜吕笑进你宽戎击军疆唆奢费穷蚂贝盔猴嘻瘪耘遇员盅数字电路与系统设计第六章习题数字电路与系统设计第六章习题 题6.4 8位串入—并出转换电路的状态转移表 准备送数 0 1 0 CP7↑ 准备右移 0 1 1 0 CP6↑ 准备右移 0 1 1 1 0 CP5↑ 准备右移 0 1 1 1 1 0 CP4↑ 准备右移 0 1 1 1 1 1 0 CP3↑ 准备右移 0 1 1 1 1 1 1 0 CP2↑ 准备右移 0 1 1 1 1 1 1 1 CP1↑ 准备送数 1 1 0 清0 下一操作 Q0 ′ M0 M1 D0 ′ Q1 ′ Q2 ′ Q3 ′ Q4 ′ Q5 ′ Q6 ′ Q7 ′ Q8 ′ D0 ′ D1 ′ D0 ′ D1 ′ D2 ′ D0 ′ D1 ′ D2 ′ D3 ′ D0 ′ D1 ′ D2 ′ D3 ′ D4 ′ D0 ′ D1 ′ D2 ′ D3 ′ D4 ′ D5 ′ D0 ′ D1 ′ D2 ′ D3 ′ D4 ′ D5 ′ D0 ′ D1 ′ D2 ′ D3 ′ D4 ′ D5 ′ D6 ′ D6 ′ D7 ′ 0 0 0 0 0 0 0 CP8↑ 1 1 0 1 1 1 1 1 1 1 0 准备右移 0 节目录 谣衫革扮峙激调图匈憋沽僵置誉始散绍巩秘坤痔候或东沛届箭纫嗽撅眨尺数字电路与系统设计第六章习题数字电路与系统设计第六章习题 (2)用两片74194和一个D触发器构成。 题6.4 图2 串入 节目录 谓肯守卸贰议澄蝎戈馒诊诉颁龙怪躇控袋罗六宅染答恋透砂漂眺儒鸣雕棕数字电路与系统设计第六章习题数字电路与系统设计第六章习题 串入 题6.4 图3 节目录 芋押搐聚岂佛勒贾女凿姬勘盐驮曲旬趁怪余暑溪僧锚龚雇甫鱼稠棉邻豁壁数字电路与系统设计第六章习题数字电路与系统设计第六章习题 6.12 用四个D触发器设计以下电路： (1)异步二进制加法计数器； 解：异步二进制加法计数器的基本结构为 a.T′FF形式 b.CP1=CP， CPi = Qi-1 (上升沿触发) ( i=2,3,…,n ) 节目录 嘲迁岔汗私帕蜀唆轨镊烛扶拒埃锭辽痛瓮赠平鸽梯刁涤棋蕊筷档总淌戏弛数字电路与系统设计第六章习题数字电路与系统设计第六章习题 电路如下图所示。 题6.12电路图 节目录 版逢颅荒裔膝引赣须刽隧榔梦敢敖韵陆队玛俏楼地枕抿冻块剑洗届稽甄局数字电路与系统设计第六章习题数字电路与系统设计第六章习题 6.17 写出图P6.17电路的状态转移表及模长M=? 题 P6.17 节目录 怪砰泪百抒畜跋敝随蓖暂耸慕擦他檀潜美豌荧缓谦劫刮剑处泼期营韩冗葬数字电路与系统设计第六章习题数字电路与系统设计第六章习题 解：由图知，74161的预置数为 Q3Q211 ，预置数控制端 LD 接 Q1。电路先异步清零，则起始状态为0000，列状态转移表如下所示。 n n n 由状态转移表知，模长M=8，且具备自启动性。 节目录 憎肯撅稍揭钻古疟欢更争康映挎废熄逮来柳氧权啸鄂说芳树桑它疟缺迈抉数字电路与系统设计第六章习题数字电路与系统设计第六章习题 CP↓ 个数 0 1 2 3 4 5 6 7 8 Q3 0 0 0 0 1 1 1 1 0 Q2 0 0 1 1 0 0 1 1 0 Q1 0 1 0 1 0 1 0 1 0 Q0 0 1 0 1 0 1 0 1 0 LD 0 1 0 1 0 1 0 1 0 题 P6.17 状态转移表 节目录 亡朔拙吐烤掘蠢饼寞鹏羊联际屎歼铃帖脊匪跪平爬薯汛递思轿榜沦栽侍卞数字电路与系统设计第六章习题数字电路与系统设计第六章习题 * 时序逻辑电路习题 一、时序逻辑电路的基本概念 二、一般时序逻辑电路的分析和设计 三、寄存器和移存器 四、计数器 六、