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南 阳 理 工 学 院毕业设计（论文）任务书电子与电气工程 学院 电子信息工程 专业 109411班 学生 王晓宁 学号 105090440022 指导教师? 曹原 职称 讲师 毕业设计（论文）题目： 基于Verilog-HDL的数模转换器的设计 二、毕业设计（论文）工作规定进行的日期： 2013年12月21日到2014年5月14日三、任务书的内容：选题的目的、意义：本题目主要研究Verilog-HDL语言在高速D／A转换器中的应用。选取高速D／A转换器的典型结构，可以将D／A转换器划分为结构和功能相互独立的各个电路模块，分析各模块功能的行为特点，建立相应的理想行为模型，使用Verilog语言对行为模型进行描述，同时采用软件对各行为模型进行仿真，并对仿真波形进行分析；在此基础上对各理想的行为模型进行了误差分析，根据理想模型和实际的电路的对比，对原有模型进行了修正，修改了模型代码，再次使用软件对修正后的模型进行仿真，将仿真波形与实际电路的特性进行了比较。本题目的研究实现了在D／A转换器的高层次设计中，使用Verilog语言代替实际电路模块的可行性和有效性。主要内容及技术要求：首先分析D／A转换器的分类和性能参数，同时对各种类型的D／A转换器的特点进行了对比研究，为高速D／A转换器结构的选择创造了条件。然后介绍了模拟硬件描述语言Verilog，了解Verilog描述行