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二. 异步计数器 1. 二进制计数器 ②异步二进制减法计数器 2、异步十进制加法计数器 器件实例：二－五－十进制异步计数器74LS290 器件实例： 74LS161 三、任意进制计数器的构成方法 例：将十进制的74160接成六进制计数器 例：将十进制的74160接成六进制计数器 （a）进位置补法 （b）任意置数法 N1和N2间的连接有两种方式： 并行进位方式：用同一个CLK，低位片的进位输出 作为高位片的计数控制信号（如74160的EP和ET）。 b. 串行进位方式：低位片的进位输出作为高位片的 CLK，两片始终同时处于计数状态。 例：用74160接成100进制 例：用两片160接成100进制计数器 ② M不可分解 采用整体置零和整体置数法： 先用两片接成 M’ M 的计数器 然后再采用置零或置数的方法 例：用74160接成29进制计数器 6.11、6.12、6.13、 6.15、6.18、6.20 * 6.3.2 计数器 应用：用于计数、分频、定时、产生节拍脉冲等 分类：按时钟分，同步、异步 按计数过程中数字增减分，加、减和可逆 按计数器中的数字编码分，二进制、二-十进制和 循环码… 按计数容量分，十进制，六十进制… 6.3 若干常用时序逻辑电路 一、同步计数器 1、同步二进制加法计数器 原理：根据二进制加法运算规则可知：在多位二进制数末位加1，若第i位以下皆为1时，则第i位应翻转。 由此得出规律，若用T触发器构成计数器，则第i位触发器输入端Ti的逻辑式应为： 状态转换图 逻辑功能：4位同步二进制加法计数器 时序图 分析功能 若CLK的频率为 f 同理： 这是二进制加法计数器。 Q0端为二分频端 则Q0端输出脉冲频率为1/2 f 计数器的另一个作用是分频： Q 1、Q 2、 Q 3端分别为四分频、 八分频和十六分频端。 2、同步二进制减法计数器 由此得出规律，若用T触发器构成计数器，则第i位触发器输入端Ti的逻辑式应为： 原理：根据二进制减法运算规则可知：在多位二进制数末位减1，若第i位以下皆为0时，则第i位应翻转。 ① 异步二进制加法 计数器 在末位+1时，从低位到高位逐位进位方式工作。 原则：每1位从“1” 变“0”时，向高位 发出进位，使高位翻转 在末位+1时，从低位到高位逐位进位方式工作。 原则：每1位从 “1”变“0”时， 向高位发出进位， 使高位翻转。 1 2 3 4 5 6 7 8 9 10 原理： 在4位二进制异步加法计数器上修改而成， 要跳过 1010－1111这六个状态。 分析时要从JK和时钟clk两方面考虑。 计数 1 1 1 1 保持（C=0） 0 X 1 1 X 保持（包括C） 1 0 1 1 X 预置数（同步） X X 0 1 置 0（异步） X X X 0 X 工作状态 4位同步二进制计数器 集成同步十进制加法计数器74LS160。电路框图、功能表 和74LS161相同，但输出只有0000－1001十个稳定状态。 器件实例： 74LS160 计数 1 1 1 1 保持（C=0） 0 X 1 1 X 保持（包括C） 1 0 1 1 X 预置数（同步） X X 0 1 置 0（异步） X X X 0 X 工作状态 4位同步十进制计数器 N进制 M进制 将已有的N进制芯片，组成M进制计数器，是常用的方法。 有两种情况： 原理：计数循环过程中设法跳过N-M个状态。 具体方法：置零法和置数法两种。 1、N M （1）置零法 （利用RD端） 计数 1 1 1 1 保持（C=0） 0 X 1 1 X 保持（包括C） 1 0 1 1 X 预置数（同步） X X 0 1 置 0（异步） X X X 0 X 工作状态 异步置零法 实际中包括0101这个状态吗？ 这是个几进制计数器？ 异步置零法 清零信号取0110 状 态 转 换 图 改进电路 （2）置数法（利用LD端） （a）进位置补法 例：将74161接成六进制计数器 1010～1111 ， （6）补＝16－6＝10＝(1010)2 （a）进位置补法 1010～1111 例：将十六进制的74161接成六进制计数器 （6）补＝16－6＝10＝(1010)2 为什么要加非门？ （b）任意置数法 例：将十六进制的74161接成六进制计数器 2. N M M=N1×N2 先用前面的方法分别接成N1和N2两个计数器。 4位同步二进制计数器74160功能表 计数 1 1 1 1 保持（C=0） 0 X 1 1 X 保持（包括C） 1 0 1 1 X 预置数（