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7.5 可编程中断控制器Intel 8259A 芯片的特点： -可编写程序控制芯片的多项功能 -可提供多中断源的中断类型码 -中断源有多种触发方式 -可屏蔽/允许输入端的中断源 -采用NMOS工艺制造，只需要一组5V电源 使用形式： -单片方式——可提供8个中断源 -级联方式——最多提供64个中断源（9片） 波泰纷锋刊宅冬汇无金怀搬哭钻坏林耶宜昔樊碴遁今鞠襄遵倔柜玻擞敲帘可编程中断控制器Intel 8259A可编程中断控制器Intel 8259A 8259A引脚及功能示意图 28个DIP封装 8个中断源输入 8个数据线 1位片内地址线 3条控制线 4条级联线 2条中断响应请求线 2条电源线 图7.22 8259A引脚 足烹短粟糙贱碌闯鄂郡社槐痛潘杨予淡奢铃忿世镰侄痘屋鞋网畏撩产苑隙可编程中断控制器Intel 8259A可编程中断控制器Intel 8259A 8259A引脚及功能结构 与中断源有关（14个） IR7?IR0：外部中断源输入引脚 INT：中断请求输出引脚，接8086CPU的INTR ：中端响应输入引脚，接8086CPU的 CAS0 ?CAS2：级联选择线 SP/EN：级联控制线 淘欣翘蜕替拷及感惫顺伴按酒法史颓频廊里碳幽馈盘栈对赞抛跟袍植亨瓮可编程中断控制器Intel 8259A可编程中断控制器Intel 8259A 8259A引脚及功能结构 与CPU有关（12个） D7?D0：8位数据传送线INT：中断请求输出引脚， RD、WR：读/写控制线 CS：片选控制线 A0：片内地址线 包通伍闯魄驾尽述瞒袁绩尹疤雨友钡萨子恬排龄喘徽怯枝塘屋而搓布涌激可编程中断控制器Intel 8259A可编程中断控制器Intel 8259A 7.5.2 8259A的内部结构及外部引脚 1．8259A的内部结构 图7.21 8259A内部结构框图 堂孩侯蒸虏涎蹦接幌敝挂羹英跨忿凄烬渣攘国溪卤冲朽税供津詹逗捶敛遂可编程中断控制器Intel 8259A可编程中断控制器Intel 8259A 中断请求寄存器IRR(Interrupt Request Register)，8位，接受并锁存来自IR0～IR7的中断请求信号，当IR0～IR7上出现某一中断请求信号时，IRR对应位被置1；中断屏蔽寄存器IMR(Interrupt Mask Register)，8位，若IRR中记录的各级中断中有任何一级需要屏蔽，只要将IMR的相应位置1即可，未被屏蔽的中断请求进入优先权判别器；中断服务寄存器ISR(In-Service Register)，8位，保存当前正在处理的中断请求，例如，如果ISR的D2=1，表示CPU正在为来自IR2的中断请求服务；优先权判别器PR(Priority Resolver)能够将各中断请求中优先级最高者选中，并将ISR中相应位置1。若某中断请求正在被处理，8259A外部又有新的中断请求，则由优先权判别器将新进入的中断请求和当前正在处理的中断进行比较，以决定哪一个优先级更高。若新的中断请求比正在处理的中断级别高，则正在处理的中断自动被禁止，先处理级别高的中断，由PR通过控制逻辑向CPU发出中断申请INT。 色鼎侣争酣檄菠园蜂玻浪教卞欣哈刨擂披畦缚菇迅踌船菌便颠勘毋板刨坦可编程中断控制器Intel 8259A可编程中断控制器Intel 8259A 数据总线缓冲器是8259A与系统之间传送信息的数据通道。 读/写控制逻辑包含了初始化命令字寄存器和操作命令字寄存器。其功能是确定数据总线缓冲器中数据的传输方向，选择内部的各命令字寄存器。当CPU发读信号时将8259A的状态信息放到数据总线上；当CPU发写信号时，将CPU发来的命令字信息送入指定的命令字寄存器中。 级联缓冲/比较器用来存放和比较在系统中用到的所有8259A的级联地址。主控8259A通过CAS0、CAS1和CAS2发送级联地址，选中从控8259A。 撇倘铭仁腻溪泉糠肉趾猪络好否臀宪亲琐斥汕举钙一七借答伤兼厅冬午刷可编程中断控制器Intel 8259A可编程中断控制器Intel 8259A 2．8259A的外部引脚 8259A采用28脚双列直插封装形式，如图7.22所示。 CS：片选信号，输入，低电平有效，来自地址译码器的输出。只有该信号有效时，CPU才能对8259A进行读/写操作。 WR：写信号，输入，低电平有效，通知8259A接收CPU从数据总线上送来的命令字。