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第八章扩频码同步
主要内容：
8.1 扩频系统同步概述
8.2 PN码捕获与跟踪
8.3 全数字非相干延迟PN码跟踪环
;传输信息带宽远大于传输该信息所需要的最小带宽;跳频系统的同步 ;PN码捕获 ; PN码捕获
;设 Q支路输入 ;判决器的输入信号;当判决值大于门限值，认为已捕获。
否则本地时钟控制扣除一个序列生成时钟周期，使本地PN 码相位调整一个码片位移，进行下一符号周期的相关运算与判决。;基于匹配滤波器的并行PN码捕获 ;对扩频信号以2倍码片速率采样并将其输入到移位寄存器。
移位寄存器中信号与本地扩频序列相乘后再相加，得到两个序列的相关值。
相关值与门限值比较判决是否达到同步。
并行捕获: 每一个码片内都能得到相关值
;基带延迟锁相PN码跟踪环（DLL） ;鉴相器
改造PN码自相关函数 得到误差信号;鉴相特性曲线;接收序列分别移位;8.3 全数字非相干延迟锁相环; 超前、滞后鉴相得多比特误差信号，门限判决将其转成超前／滞后二元误差值。
数字序贯滤波器可增、减计数，对门限判决后产生的超前／滞后脉冲作向上／向下计数。当其计数值超过某数值时，输出脉冲增／减控制信号并复位。;二元误差值经序贯滤波1后，输出增／减控制信号，控制增减二分频电路插/扣脉冲，调整PN码相位，但不能使误差为0；
本环路再将滤波1输出的增／减控制信号再经过滤波2，由滤波2输出的增／减控制信号，调整NCO时钟，使其误差为0。
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