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EDA技术与应用讲义第5章第1节VHDL基本语句一VHDL基本语句语法
第5章 VHDL基本语句（一） EDA技术与应用 课程讲义;本章内容 ;下一章内容;先看一个VHDL代码的例子;简单代码结构： 端口定义 电路逻辑表达 ;ENTITY 和 ARCHITECTURE;简单代码结构： PORT 与 ENTITY;ENTITY的定义语法;简单代码结构： LOGIC 与 ARCHITECTURE ;ARCHITECTURE的语法;代码文件 的 名称 ？ ;标识符 命名要点;这段DFF代码中的 关键词;进程 ( PROCESS );关于 进程 ( PROCESS )的疑问？;何时 PROCESS 被执行？ 进程敏感量;看看此PROCESS的电路？;可以有多个进程出现吗？;多个进程之间如何通信？;端口: Port;ENTITY DFF1 IS
PORT ( CLK : IN STD_LOGIC;
D : IN STD_LOGIC;
Q : OUT STD_LOGIC
);
END entity DFF1;
;VHDL代码中的变量：Port,Siganl,Variable;Signal 的一个例子;PROCESS 外， Signal的多重赋值 ？;信号（SIGNAL）：总结;Signal: 定义错误吗？;变量：Variable;变量（ VARIABLE ）：总结;Signal Variable 比较;学会简单VHDL设计的三板斧;与C 代码中的函数 的区别 ？ ;VHDL C 调试过程 的区别 ？;操作符：分类;操作符（一）：Arithmetic ;Arithmetic operator: 举例;操作符（二）：Comparison ;Comparison operator: 举例;操作符（三）： logical ; logical operator: 举例;数据类型;一位信号的类型表达;N位信号的类型：数组;数据类型用法 举例;赋值语句：描述 ;赋值语句：举例;不同宽度信号之间的 赋值 和 转换; 相同数值 赋给 多位数据的 的方法;逻辑分支语句：IF;看 2段代码 中 IF的用法;不完整IF语句与时序电路;IF语句：总结 ;4种 IF 语句 ;IF语句: 语法（BNF表达）;IF语句:用途;CASE：例子（逻辑分支语句）;CASE：语法;CASE语句:用途;CASE语句:一些错误表达;IF语句 和 CASE语句 混合使用的问题;循环语句:LOOP/FOR;3种类型 的循环 语句 ;LOOP语句的例子（一）;LOOP语句的例子（二）;LOOP语句的例子（三）;LOOP语句的例子（四）;; 以下内容 为 正文的引用， 可不阅读。;硬件描述语言：起源;如何使用VHDL来设计电路？;返回;MAX+PLUS II BNF;STD_LOGIC的取值
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