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兼容DVB-RCSRCS2标准的Turbo编译码器IP核
兼容DVB-RCS/RCS2标准
的Turbo编译码器IP核
2016.6发布
Turbo编译码器IP特点：
兼容DVB-RCS/RCS2标准
部分并行结构，实现高速处理。
XC6VLX240T芯片综合最高时钟频率
0
可达150MHz 10
53字节 1/3码率
信息数据吞吐率最大可以超过 -2
10
50Mbps, 若吞吐率要求小，资源可
-4
进一步减少 10
R
E
译码迭代次数可配置，最大迭代次数 B
-6
10
为8, 资源优化 ，见后面表格
-8
右图中给出的是FPGA下载测试的8次 10
迭代BER性能曲线
-10
10
提供完整的MATLAB仿真程序和 0 0.5 1 1.5 2 2.5 3
Eb/No in dB
testbench测试程序
Turbo 编码器IP封装管脚说明：
IN: i_rst ，全局复位信号
IN: i_clk ，工作时钟
IN: i_std ，标准选择信号
IN: i_data ，输入未编码数据
IN: i_data_en ，输入数据有效信号
IN: iv_blockLen ，码长选择
IN: iv_codeRate ，码率选择
I
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