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e4NEDA算法的二维DCT硬件加速器的设计实现
25卷第5期 微电子学与计算机 Vd．25No．5
2008
2008年5月 MIaRoELECTRoNICSCOMPUTERMay
基于NEDA算法的二维DCT硬件加速器的设计实现
王继东，张会生，范忠亮
(西北工业大学电子信息学院，陕西西安710072)
摘要：应用二维DcT的图像压缩系统，DCT的运算量较大，为了突破该瓶颈，设计了基于NEDA算法的DCr硬
件加速器，该设计方案采用移位相加代替乘法运算，并用RAM代替ROM，有效地节省了硬件资源．给出了Verilog
仿真结果，结果表明该加速器可以在使用资源非常少的情况下，正确地实现二维DCT运算，适合于各种视频图像
压缩方面的应用．
关键词：DCT；NEDA；n】GA；图像压缩
中图分类号：TP39 文献标识码：A 文章编号：1000—7180(2008)05—0165—04
ANewDistributedArithmeticArchitecture
Design
for2DDCTAccelerator
WANG
ji—dong，ZHANGHui—sheng，FANZhong-liang
of and
(CollegeElectronicsInformation，NorthwesternPolytechnicalUniversity，Xi’an710072，China)
a11 ofDCTis e-
Abstract：Forifi诅ge system atwo-dimensionalDCT，thecomputation large
compressionusing usually
for accel-
tObecomethebottleneck．Inordertobreak thebottleneck．wethe IXTIhardwale
hough tllIDLlgh presentdesign
erator thefull the indetail．Wemakeu跎ofadderandshifterre-
based∞NEDAalgorithm．Inpaper．we design
explain
hardware
and峨ROMinsteadofRAM．whichSaVesthe the
placingmultiplication r瞪Dun翳effectively．FromVerilog
thatthisaccelerator thetwo-dimensional few
simulationresults，we锄see designimplements D(丌correctly璐iIlgvery
itcanheusedina ofvideo
logicdements，and variety ccxnpressionapplications．
Keywords：DC
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