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- 2017-11-04 发布于广东
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4.4 VHDL文本输入设计方法初步 4.4.4 时序仿真 图4-22 设定仿真时间长度 (3) 设置波形参量 图4-23 为输入信号设定必要的测试电平或数据 (4) 为输入信号加上激励电平并存盘 图4-24 为输入信号假如时钟激励信号 (4) 为输入信号加上激励电平并存盘 4.4 VHDL文本输入设计方法初步 4.4.4 时序仿真 图4-25 保存仿真波形文件 (4) 为输入信号加上激励电平并存盘 4.4 VHDL文本输入设计方法初步 4.4.4 时序仿真 图4-26 运行仿真器 (5) 运行仿真器并观察分析波形。 4.4 VHDL文本输入设计方法初步 4.4.4 时序仿真 图4-27 多路选择器mux21a的仿真波形 (5) 运行仿真器并观察分析波形 4.4 VHDL文本输入设计方法初步 4.4.4 时序仿真 图4-28 打开延时时序分析窗 (5) 运行仿真器并观察分析波形 4.4 VHDL文本输入设计方法初步 4.4.4 时序仿真 图4-29 mux21a项目的设计层次 (1) 了解设计项目的结构层次。 4.4 VHDL文本输入设计方法初步 4.4.5 设计项目的其他信息和资源配置 图4-30 适配报告中的部分内容 (1) 了解设计项目的结构层次。 4.4 VHDL文
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