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第五章 数字集成电路中的基本模块(二)——时序逻辑电路
数字集成电路
原理 5.2 时序逻辑电路
春季学期
北京大学
微电子学系
甘学温 教授
522
上讲回顾
w 组合逻辑 电路没有对工作状态的记忆功能
w 电路的输出只决定于当前的输入变量
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北京大学信息科学技术学院微电子学系
523
时序逻辑电路
w 时序逻辑 电路的输出不仅 与 当前的输入变
量有关,还与系统原来的状态有 关,必须
有存储部件用来记忆电路前一时刻的工作
状态
w 输 出方程 Y(n)= f X (n),Z(n)
1 ( )
w 状态方程 Z(n+ 1)= f X (n),Z(n)
2 ( )
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北京大学信息科学技术学院微电子学系
524
时序逻辑电路
w 5.2.1 双稳态电路
w 5.2.2 触发器
w 5.2.3 移位寄存器
w 5.2.4 计数器
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北京大学信息科学技术学院微电子学系
525
双稳态电路
w 电路结构:两个反相器输入、输出交叉耦合
w 两个稳定工作点 A、B
一个亚稳态 C
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北京大学信息科学技术学院微电子学系
526
双稳态电路
w 从 亚稳态向稳定工作点转换的过程,可以看作一
个接近转换 电平的初始信号经过一定级数 的反相
器链传递,变为合格的逻辑电平
w 双稳态电路所处的状态是随机的,无法控制
w 配上输入控制 电路,可构成各种触发器
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北京大学信息科学技术学院微电子学系
527
时序逻辑电路
w 5.2.1 双稳态电路
w 5.2.2 触发器
Ë RS锁存器和RS触发器
Ë D锁存器和D触发器
Ë JK锁存 器
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