第21章触发器和时序逻辑电路下.pptVIP

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2018-05-26 发布于上海
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第21章触发器和时序逻辑电路下.ppt

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第21章触发器和时序逻辑电路下

(4-*) 小结一、双稳态触发器的图形符号、逻辑功能、各端的功能、工作特点及其真值表；（RS、JK、D、T）二、寄存器原理及分析，画波形图、列状态表；五、555定时器原理及其构成的单稳态触发器和无稳态触发器电路的工作原理。四、集成计数器的了解和应用；三、计数器的原理分析，画波形图、列状态表；（二进制、十进制、任意进制）作业:21.3.2、21.3.8、21.5.1、21.5.4 第32页/共32页 * * * * * * * (4-*) Q4 Q4 J4 K4 Q3 Q3 J3 K3 Q2 Q2 J2 K2 计数脉冲 C Q1 Q1 J1 K1 Q1 Q2 Q3 Q4 F1 F2 F3 F4 Q4 Q3 Q2 Q1 C 0 0 0 0 0 1 0 0 0 1 2 0 0 1 0 3 0 0 1 1 4 0 1 0 0 5 0 1 0 1 6 0 1 1 0 7 0 1 1 1 8 1 0 0 0 9 1 0 0 1 10 0 0 0 0 状态表波形图 Q2 Q3 C Q1 Q4 0 0 0 0 0 0 0 0 第1页/共32页 (4-*) 1.异步二 - 五 - 十进制计数器 74LS290 74LS290 内部含有两个独立的计数电路：一个是二进制计数器(CP0为其时钟，Q0为其输出端)，另一个是五进制计数器(CP1为其时钟，Q3Q2Q1为其输出端)。一. 数字集成电路计数器的应用第2页/共32页 (4-*) 74LS290原理电路图： CP0 R0(1) R0(2) S9(1) S9(2) CP1 FF3 J K SD RD Q Q FF2 J K SD RD Q Q FF1 J K SD RD Q Q FF0 J K SD RD Q Q Q0 Q1 Q2 Q3 R0(1)、 R0(2)直接置0端 S9(1)、 S9(2)直接置9端第3页/共32页 (4-*) CP1 CP0 R 0(1) R 0(2) S 9(2) S 9(1) UCC Q0 Q1 Q2 Q3 GND 1 2 3 4 5 6 7 14 13 12 11 10 9 8 74LS 290管脚分布图 74LS290 第4页/共32页 (4-*) 1 1 0 X 0 0 0 0 1 1 X 0 0 0 0 0 R 0(1) R 0(2) S 9(1) S 9(2) Q3 Q2 Q1 Q0 X X 1 1 1 0 0 1 0 X 0 X 0 X X 0 X 0 0 X X 0 X 0 计数状态 74LS 290功能表第5页/共32页 (4-*) 分析：计数时钟先进入CP0时的计数编码。 CP0 CP1 Q1 Q3 Q2 Q0 2 5 Q3 Q2 Q1 0 0 0 0 0 1 0 1 0 0 1 1 1 0 0 Q3 Q2 Q1 CP1 Q0 CP0 十进制数 0 0 0 1 1 0 0 0 0 0 0 0 1 0 2 0 0 1 1 3 0 1 0 0 4 0 1 0 1 5 0 1 1