总线操作及时序.pptxVIP

第七章节8086时序时钟周期(T状态周期)机器周期(总线周期)1.时序概念:指令周期空闲状态周期TI等待周期Tw存储器及外设读写周期2.典型总线周期中断响应周期总线请求/响应周期1. 有利于我们深入了解指令的执行过程2. 有利于我们在编程时适当选用指令以缩短指令的存贮空间和指令执行时间举例3. CPU与存贮器或I/O端口连接时，要考虑如何实现时序上的配合4. 微型机用于实时控制时,必须估计或计算CPU完成操作所需时间,以便与控制过程配合T1T2T3T47.1时钟周期、总线周期和指令周期1.时钟周期 (T状态周期Clock Cycle)微处理器内部操作的最基本时钟单元，宽度为时钟信号相邻两上升沿之间的时钟间隔。总线周期总线周期T1T2T3T4TIT1T2T3T4CLKAD地址数据地址数据2.机器周期(总线周期Bus Cycle) 微机处理器BIU与外部电路之间进行一次数据传送操作所占用的时间，包含若干个时钟周期。3.指令周期(Instruction Cycle) 执行一条指令所需要的时间，由一至若干个机器周期组成。7.2系统的复位操作8086CPU的RESET引脚是用于系统复位的，可完成系统复位和启动操作，复位时，CPU内部的寄存器状态为：标志寄存器FR、指令指针IP、段寄存器DS、SS、ES清零，指令队列清空，段寄存器CS置为FFFFH。实际上，除了CS外，所有内部寄存器都清零。启动后，从内存的FFFF0H开始执行程序，FFFF0H处一般存放一条无条件转移指令，转向系统程序的入口地址。至少四个时钟周期CLKREST内部REST控制线ALE、HLDA地址线8086CPU复位时序图总线周期总线周期T1T2T3T4TIT1T2T3T4CLKAD地址数据地址数据7.3总线操作与时序Intel 8086微处理器采用总线复用操作方式8086的16位数据总线和地址总线的低16位是共用的，典型的总线周期如图在没有插入等待时钟周期TW的情况下，总线周期由4个时钟周期组成，即图中T1、T2、T3、T4在T1期间CPU把存储器或外设的地址放到总线上，这些地址信息由ALE控制锁存到地址锁存器中，以便使总线上可以传送数据信息。T2期间分时复用的地址/数据总线处于高阻态，以便为读入或写出数据作准备。在T3和T4期间，读或写的数据出现在总线上，以使完成读或写的操作。一个总线周期TWT4T1T2T3地址总线数据输入地址输出READYREADY信号的定时波形等待周期TW：如果在T3周期结束之前，存储器或外设未准备好数据传送，就要启动输入CPU的READY线使之变低电平，从而在T3和T4之间插入一个或多个TW等待周期，直到READY变高，转入T4周期，完成读写操作。空闲状态周期TI：8086执行部件EU和总线接口部件BIU在一定程度上独立并行工作，只有当BIU为了填满指令队列或EU执行指令需要与外部交换数据时，申请一个总线周期，此时BIU才执行一个总线周期。因此在两个总线周期之间，可能会存在一些BIU空闲时钟周期。一个总线周期T4T1T2T3CLK低=I/O，高=MM/IOA19/S6 ~ A16/S3S6~S3A19~A16BHE/S7AD15 ~ AD0DATA INA15~A0ALERDDT/RDEN一、8086读总线周期举例一个总线周期TWT4T1T2T3CLK低=I/O， 高=MM/IOA19/S6 ~ A16/S3S6~S3A19~A16BHE/S7AD15 ~ AD0DATA INA15~A0ALERDDT/RDENREADYREADYWAIT二、8086具有等待状态的读总线周期一个总线周期T4T1T2T3CLKALE高=I/O，低=MM/IOA19/S6 ~ A16/S3S6 ~ S3A19 ~ A16BHE/S7AD15 ~ AD0DATA OUTA15~A0WRDT/RDEN三、8086写总线周期一个总线周期TWT4T1T2T3CLKALE高=I/O，低=MM/IOA19/S6 ~ A16/S3S6 ~ S3A19 ~ A16BHE/S7AD15 ~ AD0DATA OUTA15~A0WRDT/RDENREADYREADYWAIT四、8086具有等待状态的写总线周期~~~~~~~~T4 OR TICLKHOLDHLDAAD15 ~ AD0A19/S6 ~ A16/S3五、8086最小模式下的总线保持第二个中断响应周期第一个中断响应周期T3T1T2T1T3T2T4T4CLKALEINTAAD0 ~ AD15向量类型DEN六、8086中断响应周期eg. 使AX清零MOV AX, 0 三字节4TSUB AX, AX 二字节3TXOR AX, AX 二字节3Teg. MOV AX, [2000H] 设 DS=1000H，[12000H]=6