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第7章 输入输出接口 主要内容： 7.1 I/O接口基础和传送方式 7.2 中断及中断方式 7.3 定时器/计数器(8253/8254) 7.4 并行口8255A 7.5 A/D和D/A转换 第四节并行接口8255A 7.4并行口8255A 主要内容： 7.4.1 8255A的内部结构 7.4.2 8255A的引脚信号和功能 7.4.3 8255A的控制字和工作方式 7.4.4 8255A与系统总线的连接 7.4.5 键盘及其接口 7.4.6 LED数码管及其接口 典型并行接口8255A 8255A是具有多种功能的可编程并行接口电路芯片。 由于它是可编程的，可以通过程序来设置芯片的工作方式。 通用性强，使用灵活，可为多种不同CPU与外设之间提供并行输入/输出通道。 7.4.1 8255A的内部结构 7.4.1 8255A的内部结构 8255A是具有多种功能的可编程并行接口电路芯片 其内部最基本的接口部件是： 三态缓冲器 锁存器 7.4.1 8255A的内部结构 此外，还包括与CPU的联络电路及与外设的联络电路： 状态寄存器 控制寄存器 端口译码电路 控制电路（如读写控制、中断控制） 7.4.1 8255A的内部结构 8255有3个8位的数据端口（A/B/C），共24个I/O引脚，各端口共有3种输入输出工作方式 基本输入/输出（A/B/C口） 选通输入或选通输出（A/B口） 双向选通（A口） 1. 并行数据端口A、B、C 2. A组控制和B组控制 两组控制电路接收信息: 一方面接收来自芯片内部总线上的控制字； 一方面接收来自读/写控制逻辑电路的读/写命令，由此决定两组端口的工作方式和读/写操作。 2. A组控制和B组控制 A组控制电路：控制端口A与端口C的高4位 （PC7-PC4）的工作方式和读/写操作 B组控制电路：控制端口B与端口C的低4位 （PC3-PC0）的工作方式和读/写操作 2. A组控制和B组控制 3. 数据总线缓冲器 8255A包含一个双向的8位数据缓冲存储器，既可以输入，又可以输出数据。 CPU执行输出指令时：可将控制字或数据通过该缓冲器传送给8255A CPU执行输入指令时： 8255A通过该缓冲器将状态信息或数据传送给CPU 4. 读/写控制逻辑电路 　读/写控制逻辑负责管理整个8255A的数据传输方向及传输过程。 接收CS和来自系统地址总线A1、A0的信号 控制总线RESET 、RD、WR等信号 　将信号组合后，得到对A组控制部件和B组控制部件的控制命令后，并发出命令后来完成传输。 7.4.2 8255A的引脚信号和功能 1. 与外设相连接的引脚信号 PA0-PA7， 8255A端口 A 的数据信号引线 PB0-PB7， 8255A端口 B 的数据信号引线 PC0-PC7， 8255A端口 C 的数据信号引线 2. 与CPU相连接的引脚信号 RESET：高电平有效时，清除8255A所有控制字寄存器内容，并将各端口置为输入方式。 D0 ~ D7： 8255A的数据线 RD：读出信号，CPU从8255A读数据 WR：写入信号，将控制字或数据写入8255A CS: 芯片选择信号 8255A与8088系统的连接示意图 7.4.3 8255A 控制字和工作方式 方式选择控制字：--------确定3个端口的工作方式 端口C置1/置0控制字：--------确定C口某一位的初始状态 方式0： 相当于三个独立的8位简单接口 各端口既可设置为输入口，也可设置为输出口，但不能同时实现输入及输出 C端口可以是一个8位的简单接口，也可以分为两个独立的4位端口 常用于连接简单外设（适于无条件或查询方式） 方式0的应用： 常使A端口和B端口作为8位数据的输入或输出口，使C口的某些位作状态输入 方式0的输入时序（数据来自外设） 方式0的输出时序（数据来自CPU） 方式1 利用一组选通控制信号控制A端口和B端口的数据输入输出 A口、B口作输入或输出口，C口的部分位用作选通控制信号 A口、B口在作为输入和输出时的选通信号不同 方式1的应用 方式1主要用于中断控制方式下的输入输出 C口的8位除用作选通信号外，其余位可工作于方式0下，作为输入或输出口 方式1输入引脚：端口A 方式1输入引脚：端口B 方式1 输入联络信号 -STB——选通信号，低电平有效 由外设提供的输入信号，当其有效时，将输入设备送来的数据锁存至8255A的输入锁存器 IBF——输入缓冲器满信号，高电平有效 8255A输出的联络信号。当其有效时，表示数据已锁存在输入锁存器 INTR——中断请求信号，高电平有效 8255A输出的信号，可用于向CPU