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电子技术课件第六章6.1组合逻辑电路的分析
得智慧胜似得金子； 选聪明强如选银子。 箴言16:16 6.1 组合逻辑电路的分析 6.1.2 组合逻辑电路的设计 6.2.1 编码器 2 二 – 十进制编码器 6.2.2 译码器和数字显示 CT74LS139型译码器 3 二-十进制显示译码器 6.3 数据分配器和数据选择器 6.3.1 数据选择器 6.3.2 数据分配器 数据分配器的功能表 6.4 加法器 6.4 加法器P149 6.4.1 半加器 6.4.2 全加器 二、 加法器 P144 1、(7)、(8)、(9) P142 2 P177 八 半加器逻辑状态表 A B S C 0 0 0 0 0 1 1 0 1 0 1 0 1 1 0 1 逻辑表达式 逻辑图 =1 . . A B S C 输入 Ai 表示两个同位相加的数 Bi Ci-1 表示低位来的进位 输出 表示本位和 表示向高位的进位 Ci Si 全加：实现两个一位二进制数相加，且考虑来自低位的进位。 逻辑符号： 全加器： Ai Bi Ci-1 Si Ci CO ? CI (1) 列逻辑状态表 (2) 写出逻辑式 Ai Bi Ci-1 Si Ci 0 0 0 0 0 0 0 1 1 0 0 1 0 1 0 0 1 1 0 1 1 0 0 1 0 1 0 1 0 1 1 1 0 0 1 1 1 1 1 1 逻辑图 =1 1 Ai Ci Si Ci-1 Bi 半加器构成的全加器 1 Bi Ai Ci-1 Si Ci CO ? CO ? （三）集成全加器 14 13 12 11 10 9 8 1 2 3 4 5 6 7 74LS183 14 13 12 11 10 9 8 1 2 3 4 5 6 7 C661 双全加器外引线排列图 实现多位二进制数相加的电路，称为加法器。 （一）四位串行加法器 根据进位的方式不同，有串行加法器和超前进位加法器。 A3 B3 S3 C3 CO ? CI A2 B2 S2 C2 CO ? CI A1 B1 S1 C1 CO ? CI A3 B3 C0-1 S0 C0 CO ? CI 优点：电路简单，缺点速度慢。 CT74LS4147 编码器功能表 I9 Y0 I8 I7 I6 I5 I4 I3 I2 I1 Y1 Y2 Y3 1 1 1 1 1 1 1 1 1 1 1 1 1 输 入 (低电平有效) 输 出(8421反码) 0 ? ? ? ? ? ? ? ? 0 1 1 0 1 0 ? ? ? ? ? ? ? 0 1 1 1 1 1 0 ? ? ? ? ? ? 1 0 0 0 1 1 1 0 ? ? ? ? ? 1 0 0 1 1 1 1 1 0 ? ? ? ? 1 0 1 0 1 1 1 1 1 0 ? ? ? 1 0 1 1 1 1 1 1 1 1 0 ? ? 1 1 0 0 1 1 1 1 1 1 1 0 ? 1 1 0 1 1 1 1 1 1 1 1 1 0 1 1 1 0 例:CT74LS147集成优先编码器(10线-4线) T4147引脚图 低电平 有效 16 15 14 13 12 11 10 9 1 2 3 4 5 6 7 8 CT74LS4147 集成优先编码
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