四通道I2C多路复用器提供了地址扩展总线缓冲与故障管理.docVIP

四通道I2C多路复用器提供了地址扩展总线缓冲与故障管理.doc

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四通道I2C多路复用器提供了地址扩展总线缓冲与故障管理

四通道I2C多路复用器提供了地址扩展总线缓冲与故障管理   1、引言      随着数据处理、海量存储和通信系统的发展,用于传送诸如温度、扇速、系统电压和关键产品数据(VPD,例如:电路板标识)等信息的子系统尺寸和复杂程度成比例地增长。在这些信息的传送中,最常用的就是两线式串行总线,比如:I2C或SMBus。   在这些系统的设计中会出现若干实际问题,特别在系统规模日益扩大的情况下更是如此。首先,诸如小型可插拔式光学模块(SFP)等众多设备都具有硬连线I2C地址,故由于地址冲突的原因而无法使用多个这样的设备。其次,由于设备种类的增加以及有越来越多的I/O板卡需要在系统上进行热插拔,因此,I2C设备产生混乱并把总线保持于低电平的可能性有所增加。第三,随着等效总线电容的增加,总线定时规格的满足变得困难起来。除了这些大的系统问题之外,在安装一个新的I/O板卡时进行功率循环并不是任何规格的不间断电源都拥有的功能选项。   具有总线缓冲器的LTC4306四通道两线式总线多路复用器/开关解决了所有这些问题(表1简要列出了其特点)。上行两线式总线(SDAIN、SCLIN)上的一个主控器可通过LTC4306的总线缓冲器和多路复用器/开关连接至下行总线的任何组合。因此,相同的设备地址可在多根下行总线上使用。缓冲器在上行和下行总线之间提供了容性隔离,从而为系统负载的分割创造了条件。上升时间加速器在克服电容局限性方面起到了进一步的帮助作用。当总线处于低电平的持续时间达到了设定的长度时,阻塞低电平超时电路将使上行总线与下行总线断接,从而把上行总线解放出来,以恢复通信。最后,LTC4306的任何两线式总线引脚都可在一个带电系统上进行插拔操作,而不会对其造成损害。LTC4306可采用2.7V至5.5V的电源电压。      2、一般操作      图1示出了LTC4306的方框图,表2描述了其寄存器内容。UVLO比较器将阻止LTC4306接收命令,直到VCC电压升至2.5V(典型值)以上为止。这将确保LTC4306在其拥有足够的偏置电压之前不会试图运行。当ENABLE引脚被拉至1V以下时,LTC4306将被复位至其缺省的高阻抗状态,并且毫不理会在其两线式总线上进行的任何通??尝试。当ENABLE引脚被回拉至1.1V以上时,主控器可以恢复与LTC4306的通信。      3、与一根阻塞总线断接      当两线式总线阻塞于低电平的持续时间达到了一个设定的长度时,LTC4306将使上行总线与下行总线断接。主控器随后处于空闲状态,以在上行总线上恢复通信(假定问题的起因存在于一根下行总线上)。阻塞低电平超时电路负责监视下行SDA和SCL开关的两个共用的内部节点,并在任一个内部节点电压低于0.52V的情况下运行一个定时器。当这两个内部电压均高于0.6V时,该定时器将被复位。利用寄存器2,主控器能够设定7.5ms、15ms或30ms的时间,或者,它们也可选择停用超时功能。      4、两线式总线缓冲器和多路复用器开关提供了电容缓冲和电平移动      主控器向寄存器3写入数据,以连接至下行通道的任何组合。两线式总线缓冲器在上行SDAIN、SCLIN总线和下行总线之间提供容性隔离。由于拥有了此项功能,主控器便可在其系统的不同位置上采用LTC4306,以把一根大型总线分裂成若干个较小的总线。当连接了任何下行总线时,LTC4306将允许通过一个外部电阻器把READY引脚拉至一个逻辑高电平。   按照缺省设置,LTC4306仅与高电平的下行总线相连。与低电平下行总线相连的尝试将是劳而无功的,并将导致LTC4306把ALERT#引脚拉至低电平,以表示发生了一个故障。主控器可通过向寄存器2写入数据并指示LTC4306执行连接命令(这与下行总线的逻辑状态无关)来取代该功能。   上行和下行总线上拉电源电压可在2.2V至5.5V的范围内变化,而不受LTC4306 VCC电压的影响―― LTC4306因而能够在具有不同上拉电压的总线之间提供电平移动。为了保证同时连接多个下行通道时的正确运作,需确定LTC4306 VCC电压低于或等于所有的下行上拉电压,以维持逻辑高电平期间的通道至通道隔离度。      5、上升时间加速器缩短了上升时间      通过向寄存器2写入数据,主控器便可以起动或不起动上行总线和下行总线上的上升时间加速器。当起动时,加速器以一种受控方式接通,并向总线输送电流,以使它们在正总线转换期间以一个100V/μs的典型速率上升。这些大上拉电流使得用户能够在仍旧满足上升时间规格的同时构建庞大的重容性系统,但也进行了转换限制,以驱动长电缆。此外,由于加速器提供了强驱动,系统设计师因而能够选择大上拉电阻器来最大限度地减小总线

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