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小议ISE10.1整体的设计工具 　　[摘要]在FPGA设计复杂性不断增加，先进的生产工艺不断引入新的设计实现挑战的情况下，设计人员最关心的问题是设计工具的吞吐能力、易用性和生产力、时序收敛和设计反复能力以及解决时序和功率等问题等能力。作为业界最佳解决方案之一的赛灵思ISE设计套件也在不断推陈出新，讨论ISE Design Suite10.1版的先进性。 　　[关键词]ISE Design Suite10.1版 SmartXplorer技术 设计环境 动态功耗 　　中图分类号：TP3 文献标识码：A 文章编号：1671－7597(2008)0820024－01 　　 　　一、综述 　　 　　ISE Design Suite10.1版是一个统一的整体客户解决方案，为FPGA逻辑、嵌入式和DSP设计人员提供快达两倍的运行速度和提升多达38%的性能，极大地加快了设计实施速度。新版本采用了SmartXplorer 技术, 这一技术专门为解决设计人员所面临的时序收敛和生产力这两大艰巨挑战而开发。SmartXplorer技术支持在多台Linux主机上进行分布式处理，可在一天时间里完成更多次实施过程。SmartXplorer技术同时还为用户利用独立的时序报告监控每个运行实例提供相应的工具。 　　ISE Design Suite 10.1一举将所有的Xilinx设计工具，包括ISE Foundation、嵌入式开发套件 (EDK)、System Generator for DSP、 AccelDSP综合工具、ChipScope Pro 分析仪和ChipScope Pro Serial I/O 工具、 PlanAhead设计和分析工具以及ISE仿真器等统一在一个平台中，同时支持逻辑、嵌入式和DSP设计的全面设计环境，为FPGA逻辑、嵌入式和DSP设计人员提供赛灵思的整个设计工具产品线。 　　 　　这样做的好处是显而易见的。首先，它将更容易满足时序预算要求、 加快设计周转时间并允许一天内设计多次反复；其次，能简化引脚规划，更好地支持功率分析和优化；最后，工具也更易于使用， 所有设计工具将统一打包发布更新颁布。 　　ISE Design Suite 10.1的更快速性能主要来自于以下几个方面：1. 通过在实施针对主流和大规模密度器件进行算法优化和微调，性能平均快8%；2. 利用PlanAhead中的交互设计和分析功能获得更快的性能；3. SmartXplorer技术支持在多台Linux主机上进行分布式处理，可在一天时间里完成更多次实施过程,通过利用分布式处理和多种实施策略，性能可以提升多达38%。此外，基于策略的新实施方法，可以由工具来完成尝试优化的工作，不必再输入复杂的设计，从而允许一天内多次反复设计。”这个新的工具套件可以根据设计目标自动识别优化实施算法。在优化实施菜单中，现在设计人员可以选择“Balanced(缺省) ”选项提供性能和运行时间的平衡、选择“Timing Performance”选项提供优化性能、选择“Minimum 　　Runtime”选项提供最小化运行时间、选择“Area Reduction”在对性能影响尽可能小的情况下减少逻辑片数量、选择“Power Optimization” 在对性能影响尽可能小的情况下降低动态功耗。 　　此外，满足功率预算是FPGA设计人员面临的一项越来越大的挑战，特别是工艺几何尺寸的不断缩小进一步加剧了这一问题。ISE Design Suite 10.1中的第二代XPower功率分析工具提供了改善的用户接口，按照模块、结构层次、电源轨和使用的资源分析功率更为容易，因此进一步增强了功率估算功能。对于采用65nm Virtex-5器件和Spartan-3 Generation FPGA的设计动态功率平均可降低10%和12%。 赛灵思ISE Design Suite 10.1版软件提供了一个可定制的环境，可以通过定制来适合设计人员的特殊需要。赛灵思亚太区产品市场经理Simon Ho指出：“整个ISE Design Suite 10.1只需要一个licence就可以获得所有的赛灵思设计工具。当然，用户可以根据自己的需要来决定购买哪些选项和功能。如果以后需要增加某些功能和工具，可以很方便地加进来。” 　　在ISE Design Suite 10.1版本中主要增加了以下新的功能。 　　一是，为提高设计特性，增加了满足时序预算功能，加快了设计周期的时间（每天可以反复多次“tums-per-day”）。这是因为在ISE Design Suite 10.1新版本中采用了SmartXplorer 技术, SmartXplorer技术支持在多台Linux主机上进行分布式处理，可在一天时间里