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- 2019-06-28 发布于天津
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3.5.3 并行信号赋值语句 并行信号赋值语句有三种形式: 简单信号赋值语句 选择信号赋值语句 条件信号赋值语句 共同点是:赋值目标必须都是信号。 1 简单信号赋值语句 它语句格式如下: 赋值目标=表达式; 因为VHDL是强类型语言,所以目标信号的数据类型必须与赋值符号“=”右边表达式的数据类型一致。 2 选择信号赋值语句 选择信号赋值语句格式如下: WITH 选择表达式 SELECT 赋值目标信号=表达式1 WHEN 选择值1, 表达式2 WHEN 选择值2, …… 表达式n WHEN OTHERS; 3 条件信号赋值语句的格式如下: 赋值目标信号 = 表达式1 WHEN 赋值条件1 ELSE 表达式2 WHEN 赋值条件2 ELSE … 表达式n WHEN 赋值条件n ELSE 表达式; 注意:条件赋值语句每一子句的结尾没有任何标点,只有最后的子句有分号。 …… ARCHITECTURE ar_6 OF fzh_1 IS BEGIN y= a WHEN q=″00″ELS
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