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1.请画出下段程序的真值表,并说明该电路的功能。 LIBRARY ieee;
USE ieee.std_logic_1164.all;
ENTITY aaa IS
PORT( oe,dir :IN STD_LOGIC ;
a,b : INOUT STD_LOGIC_VECTOR(7 DOWNTO 0 ) ; END aaa ;
ARCHITECTURE ar OF aaa IS
BEGIN
PROCESS(oe , dir )
输入
输出
BEGIN a1 a0 x3 x2 x1 x0 IF oe=’0’ THEN a=”zzzzzzzz”; b=”zzzzzzzz”; 0 0 0 0 0 1 ELSIF oe=’1’ THEN 0 1 0 0 1 0
IF dir=’0’ THEN b=a; 1 0 0 1 0 0 ELSIF dir=’1’ THEN a=b; 1 1 1 0 0 0 ENDIF;
END IF ;
END PROCESS ;
END ar ;
功能为:2-4 译码器…………………………………………..4 分
2.请说明下段程序的功能,写出真值表,并画出输入输出波形。
LIBRARY ieee;
USE ieee.std_logic_1164.all;
USE ieee.std_logic_arith.all;
USE ieee.std_logic_unsigned.all;
ENTITY aaa IS
PORT( reset,clk: IN STD_LOGIC;
q: BUFFER STD_LOGIC_VECTOR(2 DOWNTO 0)
);
END aaa;
ARCHITECTURE bd OF aaa IS
BEGIN
PROCESS(clk,reset)
BEGIN
IF (reset=0) THEN q=000;
ELSIF (clkevent AND clk=1) THEN
IF (q=5) THEN q=000;
ELSE q=q+1;
END IF;
END IF;
END PROCESS;
END bd;
功能为:带进位借位的 4 位加/减法器。…………………………………..3 分
输入输出波形图如下:………………………………………………………7 分
m
[3..0]
[3..0]
[3..0]
1.
试用 VHDL 语言编程实现 74LS273 芯片的功能。 LIBRARY ieee;
USE ieee.std_logic_1164.ALL;
ENTITY ls273 IS
PORT(
2’
1’
clr, clk : IN std_logic;
d : IN std_logic_vector(7 DOWNTO 0 );
q : OUT std_logic_vector(7 DOWNTO 0 ); 4’ );
END ls273;
ARCHITECTURE lock8 OF ls273 IS 1’ BEGIN
PROCESS ( clk )
BEGIN
1’
IF (CLR=’0’) THEN q= ; 2’ ELSEIF (clk’event AND clk=’1’) THEN q=d; 3’ ELSEIF ( clk=’0’ ) THEN q=q; 1’ END IF;
END PROCESS;
END lock8;
3. 请用 VHDL 语言编程实现一个状态向量发生器。
LIBRARY ieee;
USE ieee.std_logic_1164.ALL;
ENTITY stas IS
PORT(
2’
1’
cp, rst : IN std_logic;
p : BUFFER std_logic_vector(7 DOWNTO 0 ); 2’ );
END stas;
ARCHITECTURE arstas OF stas IS 1’ BEGIN
PROCESS (cp ) 1’ BEGIN
IF(rst=”0”) THEN p=; 1’ ELSEIF (cp’event AND cp=’1’ ) 1’
WITH p SELECT
p= WHEN ;
WHEN ;
WHEN ;
WHEN ;
WHEN ;
WHEN ;
WHEN OTHERS; 6’ END IF
END PROCESS;
END arstas;
1. 阅读下段程序,画出该电路的真值表
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