整理D触发器原理D触发器电路图.pptxVIP

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边沿 D 触发器: 负跳沿触发的主从触发器工作时,在正跳沿前加入输入信号。如果在CP 高电平期间输入端出现干扰信号, 那么就有可能使触发器的状态出错。而边沿触发器允许在 CP 触发沿来到前一瞬间加入输入信号。这样, 输入端受干扰的时间大大缩短,受干扰的可能性就降低了。边沿D 触发器也称为维持-阻塞边沿D 触发器。 电路结构: 该触发器由 6 个与非门组成,其中 G1 和 G2 构成基本 RS 触发器。;; 维持和阻塞D 触发器的电路和动态波形 4.最高时钟频率:为保证由门G1~G4 组成的同步RS 触发器能可靠地翻转,CP 高电平的持续时间应大于 tPHL, 时钟信号高电平的宽度 tWH 应大于tPHL。而为了在下一个 CP 上升沿到达之前确保门 G5 和 G6 新的输出 电 平得以稳定地建立,CP 低电平的持续时间不应小于门 G4 的传输延迟时间和 tset 之和,即时钟信号低电平 的宽度tWL≥tset+tpd,因此得到:

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