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K X 康芯科技 2.4.1 查找表逻辑结构 图 2-25 FPGA 查找表单元内部结构 K X 康芯科技 2.4.2 Cyclone 系列器件的结构与原理 图 2-26 Cyclone LE 结构图 K X 康芯科技 2.4.2 Cyclone 系列器件的结构与原理 图 2-27 Cyclone LE 普通模式 data1 addnsub data2 data3 4- input LUT 4- input LUT cin data4 Reg Reg sload sclear aload clock ena aclr 行、列 直连线布线 LUT 链 寄存器链 行、列 直连线布线 行、列 直连线布线 寄存器链 输入 K X 康芯科技 同步装载 清零逻辑 寄 存 器 两个 2 输入 LUT ( 进位 ) 寄存器 控制信号 寄存器链 输入 Data1 Data2 Data3 行、列和 直连线布线 局部布线 两个 2 输入 LUT ( 和 ) 寄存器链 输出 addnsub 进位输出 逻辑 进位输入 逻辑 LAB 进位输入 进位输入 0 进位输入 1 进位输出 1 进位输出 0 2.4.2 Cyclone 系列器件的结构与原理 图 2-28 Cyclone LE 动态算术模式 K X 康芯科技 2.4.2 Cyclone 系列器件的结构与原理 LE1 LE2 LE3 LE4 LE5 LE6 LE7 LE8 LE10 LE9 4 4 4 4 4 4 4 4 4 4 控制信号 局 部 互 连 LAB 输入信号 LUT 链 和 寄存器链 LE 反馈信号连线 图 2-29 Cyclone LAB 结构 K X 康芯科技 2.4.2 Cyclone 系列器件的结构与原理 图 2-30 LAB 阵列 K X 康芯科技 EAB 的大小灵活可变 通过组合 EAB 可以构成更大的模块 不需要额外的逻辑单元，不引入延迟， EAB 可配置为深度达 2048 的存储器 EAB 的字长是可配置的 256x8 512x4 1024x2 2048x1 256x8 256x8 512x4 512x4 256x16 512x8 (5) 嵌入式阵列块 EAB 是在输入、输出口上带有寄存器的 RAM 块，是由一系列的嵌入 式 RAM 单元构成。 图 3-40 用 EAB 构 成不同结构的 RAM 和 ROM 输出 时钟 D RAM/ROM 256x8 512x4 1024x2 2048x1 D D D 写脉冲 电路 输出宽度 8,4,2,1 数据宽度 8,4,2,1 地址宽度 8,9,10,11 写使能 输入 时钟 K X 康芯科技 EAB 可以用来实现乘法器 VS 非流水线结构 , 使用 35 个 LE, 速度为 34 MHz 流水线结构速度为 100 MHz, EAB 8 8 90 MHz 用 EAB 实现的流水线乘法器操作速度可达 90 MHz! 实例 : 4x4 乘法器 + (6 LE) + (6 LE) + (7 LE) 8 LE LE LE LE LE LE LE LE LE LE LE LE LE LE LE LE K X 康芯科技 2.4.2 Cyclone 系列器件的结构与原理 图 2-31LAB 控制信号生成的逻辑图 CLR2 CLR1 ASYNCLOAD /LABPRE SYNCLOAD CLK1 CLKENA1 LAB 行 Clock 至每个寄存器 / 6 CLK2 CLKENA2 SYNCCLR ADDNSUB 局部互连 局部互连 局部互连 局部互连 局部互连 局部互连 EDA 技术与 VHDL 第 2 章 PLD 硬件特性与编程技术 K X 康芯科技 K X 康芯科技 PLD - P rogramable L ogic D evice FPGA - F ield P rogrammable G ate A rray CPLD - C omplex P rogrammable L ogic D evice K X 康芯科技 可编程逻辑器件（ PLD ） 传统数字系统 由固定功能的标准集成电 路构成，如： 74/51 系列、 4000 、 4500 系列等构成。 设计无灵活性，芯片种类 多数目大。 现代数字系统 仅由三种标准积木块：微 处理器、存储器以及 PLD 构成，即： CPU+RAM+PLD 的模式， PLD 是设计的核心 PLD — Programmable Logic Device ：用户构造逻辑功能 K X 康芯科技 2.1 PLD 概述 图 2-1 基本 PLD 器件的原理结构图 输入 缓冲 电路 与 阵 列 或 阵 列 输出 缓冲 电路 输 入 输 出 … … K