FPGA设计FSC1001 CORE2-5U原理图说明.pdfVIP

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CORE2-5U 原理图 2010 1 2 3 4 U1D 40 B4_IO1 4 IO, LVDS58n (DEV_OE) 41 B4_IO2 P2 SLOT2 IO, LVDS58p, (DM1B/BWS#1B) K 42 B4_IO3 5V 3.3V U1C N IO, LVDS57p, DQ1B8 43 B4_IO4 B1_IO7 1 2 B1_IO8 A 73 B3_IO1 A IO, LVDS57n, DQ1B7 44 B4_IO5 B1_IO9 3 4 B1_IO11 A 3 IO, LVDS42n, (DM1R/BWS#1R) B IO, LVDS56p, DQ1B6 5 6 74 B3_IO2

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