同步十二进制的加减法计数器定义.pdfVIP

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2021-11-30 发布于福建
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同步十二进制的加减法计数器定义.pdf

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题目：设计一个同步十二进制的加减法计数器。要求 X=1 时为加法， X=0 时为减法。实验步骤：第一步 :根据设计要求，该电路是 Moore 型同步时序电路，它是按自然态序变化。画出同步十二进制的加减法计数器的状态转换图如下所示： 0 0 0 0 0 S0 S1 S2 S3 S4 S5 1 1 1 1 1 0 1 1 0 1 1 1 1 1 S11 S10 S9 S8 S7 S6 0 0 0 0 0 第二步：状态编码。本电路是十二进制计数器，有 12 个不同的状态用 S0~S11 表示，且不能作状态化简。根据 2n-1 N 2n，当 N=12 时， n=4 ，选触发器的个数 n=4 。设 S0=0000 、S1 =0001、S2=0010 、S3=0011 、S4=0100 、S5=0101 、S6=0110 、S7=0111 、S8=1000 、 S9=1001 、S10=1010 、S11=1011 。状态编码图如下所示： /Z /0 /0 /0 /0 0000 0001 0010 0011 0100 /0 /0 /0 /0 /1 /1 1011 /1 0101 /0 /0 /0 /0 0110 1010 1001 1000 0111 /0 /0 /0 /0 /0 /0 /0 /0 现态 Q4nQ3nQ2nQ1n