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Synplify,Synplify Pro ,Synplify Premier ,Synplify Premier with DP 这 四 个 工 具 有 什么区别和用处
我现在才开始学习使用这个软件,安装好了就有这四种,我想知道它们到底有啥子不同之处,越详尽越好!一般选用哪个要好点。哪位高手帮忙给解释一下,感谢万分!
1) SynplifySynplify Pro : 基本的 synthesis tools
2) Synplify Premier : 增加 physical synthesis ( Just like physical compiler instead of Design compiler) 选项,可以在
3) Synplify Premier with DP : DP (Design planning) 增加可以手动做 design floorplanning 及 physical Analyst,(guide
如题我的 verilog 代码中使用了 designware 的乘法器与除法器,在 modelsim 调试时使用的是 sim 模型,现在准备使用synplify 综合了放 fpga 跑,所以用 syn 模型替换了 sim 的.v 文件。
不知道这个事情具体应该怎么做?如果只是用文件替换的话会报错:
reference to undefined module DW02_mult
我的.v 文件叫做 DW02_mult5x5(因为是 5bit 的乘法),在文件里有:
// Instance of DW02_mult DW02_mult #(A_width, B_width)
U1 ( .A(A), .B(B), .TC(TC), .PRODUCT(PRODUCT) );
这样的例化语句。。
实在是一头雾水,请有经验的大神指导 T.T
法,synoplify_premier 貌似有 DESIGN_WARE 的选项,你找找看。
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