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本发明提供一种SARADC电路，包括采样开关电路、第一DAC电容阵列模块、第二DAC电容阵列模块、比较器及逻辑控制电路，通过在SARADC电路中额外扩展引入第一DAC电容阵列模块，且由于第一DAC电容阵列模块中的电容的权重位所对应的电容的容值为第二DAC电容阵列模块中的最低权重位所对应的电容的容值，从而可通过第一DAC电容阵列模块以校正第二DAC电容阵列模块中最低权重位所对应的比较器的实际输出，且可推导至第二DAC电容阵列模块没有的0.5LSB权重对应的比较器输出，从而可解决高集成度、高速及
(19)中华人民共和国国家知识产权局
(12)发明专利
(10)授权公告号 CN 113258931 B
(45)授权公告日 2021.11.23
(21)申请号 202110650602.1 (51)Int.Cl.
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