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【例7.14】 三态双向缓冲器 LIBRARY IEEE; USE IEEE.STD_LOGIC_1164.ALL; ENTITY bidir1 IS PORT(y : INOUT STD_LOGIC; --y为双向I/O端口 en,a: IN STD_LOGIC; b : OUT STD_LOGIC); END bidir1; ARCHITECTURE one OF bidir1 IS BEGIN PROCESS(en,a) BEGIN IF(en=1) THEN y=a; ELSE y =Z; END IF; END PROCESS; b=y; END one; 第三十页，共五十三页，2022年，8月28日 【例7.15】 三态双向总线缓冲器 LIBRARY IEEE; USE IEEE.STD_LOGIC_1164.ALL; ENTITY ttl245 IS PORT(a,b : INOUT STD_LOGIC_VECTOR(7 DOWNTO 0); --双向数据线 oe,dir : IN STD_LOGIC); --使能信号和方向控制 END ttl245; ARCHITECTURE one OF ttl245 IS BEGIN a = b WHEN (oe=0 AND dir=0) ELSE(O