实验一3-8译码器设计.docVIP

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2023-10-11 发布于湖北
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实验一3-8译码器设计.doc

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PAGE PAGE 9 实验二 3－8译码器设计实验目的掌握3-8译码器的设计方法；掌握if else语句和case语句的使用方法；掌握VHDL电路的设计、仿真和硬件测试方法设计描述及方法设计电路的接口描述 Y7 Y7 Y6 Y5 Y4 Y3 Y2 Y1 Y0 G2B G2A G1 C B A 3－8译码器输入变量为三个A,B,C，输出变量有8个，即Y0~Y7。 G1,G2A,G2B为选通输入，仅当G1=1, G2A=0, G2B=0时，译码器能够正确输出，否则，译码器输出无效，Y0~Y7均为高电平。电路设计基本方法译码器输出连接8个二极管，低电平显示输出端有效。设计步骤完成3－8译码器的VHDL描述，并对其进行波形仿真，确定结果正确。实验思考题对于以上译码器，考虑用函数conv_integer（在程序包std_logic_unsigned中定义），该如何实现？要实现带使能端的BCD-7段译码器，该如何实现？