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ZYNQ-AX7020学习笔记

⼀.基础概念

AX7020包含两⼤部分ps(集成两个ARMcortex-a9处理器),和pL（FPGA）

PS：主频1GHZ,256KB⽚内RAM，8GbitSDRAM（以太⽹,串⼝,usb,spiflash,SD，IO,LED,KEY）

PL：可编程逻辑块，可编程IO块等（eepromRTCHDMILEDKEYADC）

互联：

PS内和PS到PL⾼宽带连接

基于ARMAMBAAXI总线

传输质量控制和带宽控制

上图很明确的标出了硬件接⼝，不同的部分需要通过不同开发⼿段开发。

1.环境搭建

(1)XilinuxFPGA开发环境Vivado

(2)linux环境搭建（⼯具链和linux版本需要注意）

FPGA编程

verilog⾏为描述语⾔是什么？？（fpga开发专⽤语⾔??）

芯⽚上电后，先运⾏的是ARM系统，然后通过ARM系统软件部分加载FPGA的⽐特流⽂件.bit⾄FPGA，启动FPGA逻辑功能。

vivado可⽤于FPGA逻辑编写和ARM裸机的编写（集成SDK）

⼆.开始学习

在之前接触的芯⽚中，要不只需要linux开发的ARM，或者是FPGA芯⽚。像这种集成两部分的芯⽚还是第⼀次遇到，所以在学习的过程

中，⼀会linux编程，⼀会fpga编程，他们之前怎么配合

也是整的迷迷糊糊。

其实这个芯⽚和我们平时的应⽤也是很相似的，3500⽅案既包括armlinux部分也包括单⽚机部分，他们⾃⼰通过不同的软件和⽅法编写

⾃⼰的，然后通过通讯接⼝进⾏数据交互，这个芯⽚

道理也是⼀样的，在这款芯⽚的学习中，设计到许多之前没接触过的名词和⼯具，接下来快速引⼊。

开发⼯具说明

XilinxVivadoVivado设计套件实现FPGA部分的设计和开发，管脚和

时序的约束，编译和仿真，实现RTL到⽐特流的设计流

程

XilinxSDK是Xilinx软件开发套件(SDK),在Vivado硬件系统的

SDK（Software基础上，系统会⾃动配置⼀些重要参数，其中包括⼯具

Development和库路径、编译器选顷、JTAG和闪存设置，调试器连

Kit）接已经裸机板⽀持包(BSP)

交叉编译⼯具要在x86的体系的主机上编译出可以在ARM体系结构中

（linux虚拟机⼯具运⾏的可执⾏⽂件，必项要⽤交叉编译⼯具链来完成

链）

1.ZYNQ芯⽚开发流程

PS和PL连接，加⼊IP核后，系统⾃动使⽤AXI接⼝将我们的IP核与处理器连接起来。

AXI接⼝

⼀种接⼝协议，主要描述主设备和从设备之间的数据传输⽅式

位于PS端的ARM直接有硬件⽀持AXI接⼝，⽽PL则需要使⽤逻辑实现相应的AXI协议。Xlinx在Vivado开发环境⾥提供现成的IP

如AXI-DMAAXI_GPIO等，使⽤的时候直接从IP列表中添加即可。

上电有要求？为什么，怎么做到上电顺序。。。

开启⼀个电源然后⽤这个当做使能脚，来使能下⼀路电源。上电顺序有要求应该和板卡部分器件特性有关。

AX7020开发板⽀持三种启动模式

1.JTAG调试模式

2.QSPIflash

3.sd卡启动模式

PS时钟源：33.333MHZ（有源

PL时钟源：50MHZ（有源

举例应该是最快理解流程的最好⽅式：

PS端控制PL端的灯

添加AXIGPIO的IP⽤于与PS通讯

PL部分需要加约束⽂件来告诉连在哪个管脚上

⽣成FPGA的⽐特流⽂件，导出SDK

在SDK⾥⾯建⽴⼯程

在我们的stm32芯⽚中，⼀个管脚也⽀持很多个功能，普通IO功能或者spi等其他功能，通过配置然后调⽤不同的

⽂件来实现功能，这⾥的形式应该是⼀样的通过调⽤不同的API函数来调⽤⽂件，IP核sdK等相当于⾃⼰配置硬件环境然后

⽣成出⼀个SDK，通过API来调⽤内容。加上linux和加上⼀个rtos系统调⽤⽅式应该是⼀样的。VIVado⽣成SDK的过程就相当于