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Verilog语言实现设计交通灯控制器

实验模块组成：

（计数器+控制器）可以分开实现，最好一起实现避免

接口对接时出错

译码器

实验要求：

1.在十字路口两个方向各设一组红、绿、黄灯，显示顺序

为：

南北方向是绿、黄、红灯；东西方向是红、绿、黄灯。

2.要求红、绿、黄灯的持续时间分别为：10s、7s、3s，

东西、南北方向各用一个数码管显示倒计时时间。

3.当任意方向出现特殊情况时，应优先放行，即使各方向

均亮红灯，倒计时停止，且显示数字闪烁。经过规定时

间之后，恢复正常运行状态。

//计数器+控制器

moduleZTJ(clk,s,count1,count2,led);

parameter

s0=6b010100,s1=6b001100,s2=6b100010,s3=6b1000

01,s4=6b100100;

inputclk,s;

output[3:0]count1;

第1页

output[3:0]count2;

output[5:0]led;

reg[3:0]count1;

reg[3:0]count2;

reg[5:0]led;

reg[5:0]st;

reg[5:0]jicun;

reg[3:0]i;

always@(posedgeclk)

if(s==0led==6b000000)

begin

led=s0;

st=s0;

count1=4b0110;

count2=4b1001;

end

elseif(s==0led!=6b000000)

begin

case(st)

s0:if(count1!=4b0000)begin

led=s0;count1=count1-1;count2=count2-1;endelse

begincount1=4b0010;st=s1;end

第2页

s1:if(count1!=4b0000)begin

led=s1;count1=count1-1;count2=count2-1;endelse

begincount1=4b1001;count2=4b0110;st=s2;end

s2:if(count2!=4b0000)begin

led=s2;count1=count1-1;count2=count2-1;endelse

begincount2=4b0010;st=s3;end

s3:if(count2!=4b0000)begin

led=s3;count1=count1-1;count2=count2-1;endelse

begincount1=4b0110;count2=4b1001;st=s0;end

default:led=s4;

endcase

end

else

begin

jicun=led;

led=s4;

count1=coun