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CC3—FetchI3并DecodeI2并EXECI1第29页，共59页，星期日，2025年，2月5日CC4—FetchI4并DecodeI3并EXECI2并MEMI1第30页，共59页，星期日，2025年，2月5日CC5—FetchI5并DecodeI4并EXECI3并MEMI2并WBI1第31页，共59页，星期日，2025年，2月5日CC6—FetchI6并DecodeI5并EXECI4并MEMI3并WBI2第32页，共59页，星期日，2025年，2月5日CC7—DecodeI6并EXECI5并MEMI4并WBI3第33页，共59页，星期日，2025年，2月5日CC8—EXECI6并MEMI5并WBI4第34页，共59页，星期日，2025年，2月5日CC9—MEMI6第35页，共59页，星期日，2025年，2月5日CC10—WBI6以上还有3个控制信号：WZ—写Z标志信号WMEM—写存储器信号WREG--写寄存器堆信号第36页，共59页，星期日，2025年，2月5日流水线处理机的控制—转移指令控制subir10,r10,1bneabcaddr1,r2,r3abc:load001010dispbnedispIfz=0,pc?(pc)+disp结果不为0，转移001011dispbeqdispIfz=1,pc?(pc)+disp结果为0，转移001100dispbranchdisppc?(pc)+disp无条件转移subir10,r10,1nopbneabcnopaddr1,r2,r3条件转移指令控制无条件转移指令控制branchabcaddr1,r2,r3branchabcnopaddr1,r2,r3第37页，共59页，星期日，2025年，2月5日第38页，共59页，星期日，2025年，2月5日第39页，共59页，星期日，2025年，2月5日第40页，共59页，星期日，2025年，2月5日转移发生的条件为BTAKEN=branch+bne?Z+beq?Z第41页，共59页，星期日，2025年，2月5日级控制信号注释IF级BTAKEN转移发生ID级SST选择STORE（rd）EXE级SIMM选择立即数?ALUOPALU操作码?WZ写Z标志MEM级WMEM写存储器WB级SLD选择LOAD?WREG写寄存器堆流水线各级控制信号的定义第42页，共59页，星期日，2025年，2月5日计算机组成原理*第1页，共59页，星期日，2025年，2月5日1、流水线处理机的基本概念2、流水线处理机的数据路径 流水线级，流水线各级的操作3、流水线处理机的控制运算指令，访存指令，转移控制指令，流水线各级信号的产生，时序图，时空图4、流水线处理机的相关结构相关，数据相关，转移相关本讲安排第2页，共59页，星期日，2025年，2月5日将解决的主要问题掌握流水线处理机的数据路径建立指令流水线中指令如何重叠执行和流动了解流水线工作原理以及相关问题第3页，共59页，星期日，2025年，2月5日单周期处理机第4页，共59页，星期日，2025年，2月5日单周期处理器的缺陷时钟周期时间长:?对于装入指令，周期时间必须足够长: 指令存储器访问时间+ 寄存器堆访问时间+ ALU计算地址+ 数据存储器访问时间+ 寄存器访问时间对于其它指令，周期时间都比所需的要长很多!第5页，共59页，星期日，2025年，2月5日多周期处理机第6页，共59页，星期日，2025年，2月5日单周期处理器的问题根源:对于最慢的指令，周期时间必须足够长解决方案:?将指令处理分为更小的步骤，每个周期执行一步（而不是整个指令）-周期时间：执行最长步所需的时间-使所有的步骤尽量具有相同的长度?这是多周期处理器的本质所在多周期处理器的优点:?周期时间短?不同的指令需要不同的周期数来完成-装入指令需要5个周期，-跳转仅仅需要3个周期?允许每条指令多次使用同一个功能部件多周期实现概述第7页，共59页，星期日，2025年，2月5日