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数字逻辑电路实验完整报告书

引言

数字逻辑电路作为计算机科学、电子信息工程等相关专业的核心基础课程，其理论知识的理解与实践能力的培养至关重要。本实验报告旨在系统记录数字逻辑电路实验的全过程，包括实验目的、原理、环境、内容与步骤、数据记录与分析、结果讨论及总结等关键环节。通过亲身参与从电路设计、搭建、调试到功能验证的完整流程，加深对数字逻辑理论的理解，掌握基本数字电路的分析与设计方法，提升动手操作与问题解决能力。本报告所涉及的实验内容涵盖了组合逻辑电路及时序逻辑电路的典型应用，具有较强的代表性与实践性。

一、实验目的

1.熟悉数字逻辑电路实验箱及相关常用仪器（如万用表、示波器）的基本操作与使用方法。

2.验证基本逻辑门（与门、或门、非门、与非门、或非门、异或门）的逻辑功能，加深对其真值表的理解。

3.掌握组合逻辑电路的分析与设计方法，能够独立完成简单组合逻辑电路（如半加器、全加器、编码器、译码器）的设计、搭建与功能测试。

4.理解触发器（如RS触发器、JK触发器、D触发器）的工作原理、逻辑功能及时序特性，能够正确使用触发器构成简单的时序逻辑电路。

5.培养综合运用所学知识解决实际问题的能力，以及严谨的实验态度和规范的报告撰写能力。

二、实验原理

2.1基本逻辑门电路

数字电路的基本单元是逻辑门，它们基于半导体器件的开关特性来实现特定的逻辑运算。常用的基本逻辑门包括：

*与门(ANDGate):只有当所有输入均为高电平（逻辑1）时，输出才为高电平；否则输出为低电平（逻辑0）。其逻辑表达式为：Y=A·B(或Y=AB)。

*或门(ORGate):只要有一个或多个输入为高电平，输出即为高电平；只有所有输入均为低电平时，输出才为低电平。其逻辑表达式为：Y=A+B。

*非门(NOTGate/Inverter):输出与输入逻辑状态相反。其逻辑表达式为：Y=?A(或Y=A)。

*与非门(NANDGate):先进行与运算，再进行非运算。其逻辑表达式为：Y=?(A·B)(或Y=(AB))。

*或非门(NORGate):先进行或运算，再进行非运算。其逻辑表达式为：Y=?(A+B)(或Y=(A+B))。

*异或门(XORGate):当两个输入相异时输出为高电平，相同时输出为低电平。其逻辑表达式为：Y=A⊕B=A?B+?AB。

2.2组合逻辑电路

组合逻辑电路的特点是任意时刻的输出仅取决于该时刻的输入，而与电路原来的状态无关。其设计通常遵循以下步骤：根据实际逻辑问题列出真值表-由真值表写出逻辑表达式-对逻辑表达式进行化简和变换-根据化简后的表达式选择合适的逻辑器件并画出逻辑电路图-搭建电路并进行功能验证。

本次实验涉及的组合逻辑电路实例为一位全加器。全加器能够实现两个一位二进制数及来自低位的进位相加，产生本位和及向高位的进位。设加数为A，被加数为B，低位进位为Ci，本位和为S，向高位进位为Co，则其真值表如下（此处省略具体真值表，实际报告中应列出），逻辑表达式为：S=A⊕B⊕Ci；Co=AB+ACi+BCi。

2.3时序逻辑电路

时序逻辑电路的输出不仅取决于当时的输入信号，还与电路原来的状态有关，即具有记忆功能。其基本单元是触发器。

*RS触发器:基本的触发器类型，具有置0（Reset）、置1（Set）功能，但存在不定状态。

*JK触发器:功能最完善的触发器之一，具有置0、置1、保持和翻转功能，克服了RS触发器的不定状态。在时钟脉冲CP的有效边沿（上升沿或下降沿）触发。

*D触发器:只有一个数据输入端D，在时钟脉冲CP的有效边沿，输出Q等于输入D的值，常用于数据锁存和移位寄存器。

本次实验涉及的时序逻辑电路实例为由D触发器构成的移位寄存器，实现数据的串行输入与并行输出功能。

三、实验环境与器材

1.数字逻辑电路实验箱:提供电源、逻辑电平输入接口、LED显示输出、面包板区域及常用集成芯片插座。

2.直流稳压电源:为实验电路提供稳定的直流工作电压（通常为+5V）。

3.万用表:用于测量电路各点电压、检测电路通断及判断芯片引脚是否损坏。

4.示波器(可选):用于观察时序电路中各点的波形，特别是时钟信号、触发信号等的时序关系。

5.集成逻辑芯片:

*74LS系列门电路芯片：如74LS00（四2输入与非门）、74LS04（六反相器）、74LS08（四2输入与门）、74LS32（四2输入或门）、74LS86（四2输入异或门）等。

*触发器芯片：如74LS74（双D触发器，带预置和清除